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DDR地址线创建port时,报错

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发表于 2021-8-24 15:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在用POWER SI工具进行频域仿真时,产生如下问题,在此求教。
5 q" Q; V# x* R- h1.地址线后端有上拉电阻时输出port时报错?错误见图片。(此处只选择了两根地址线,错误应该是和上拉电阻有关)$ R; _' Y( }' R
- i+ a0 Q1 ^) n
2.对下图中的DDR时钟线如何建立port?
8 S% J: r( d) y5 ?1 q: D" p' `7 |; Q' K7 g& P8 e+ L

; }! h7 c' s; ~0 S

“来自电巢APP”

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2#
发表于 2021-8-24 17:23 | 只看该作者
1、上拉电阻的问题
6 M0 ]2 K  ^* ~! a/ y

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3#
发表于 2022-4-21 15:06 | 只看该作者
电阻赋值,接电源的加port
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