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PCB Matrix LP中大家看看封装中的这个东西是做什么用的

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1#
发表于 2011-6-16 15:45 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如图片中所示,粉色的图框是什么啊
6 L4 c; r5 J3 R1 V0 g& Callegro中有这一层参数吗,* E( L0 S0 c  ]7 r9 I- N
它的大小又是怎么确定的呢  Q$ M+ ~9 Y& U0 u1 S- S
6 f+ Q; X5 y: x% Z4 J0 E, Q+ Y
期待高手来解答
: e' x+ Z# n2 ~7 m- G; @

未命名.JPG (87.47 KB, 下载次数: 10)

未命名.JPG

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2#
 楼主| 发表于 2011-6-17 10:24 | 只看该作者
怎么没有人来回答呢

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3#
发表于 2011-6-17 12:34 | 只看该作者
       鼠标单击该软件的“工具栏”中的“Layers” ,会弹出“Layer Setup”对话框,在里面找到该颜色层的名称为:“Courtyard”,就是元件封装中用到的“PLACE_BOUND_TOP”。

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4#
发表于 2011-6-17 12:37 | 只看该作者
至于怎么确定的,需要有行业标准才行

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5#
 楼主| 发表于 2011-6-20 09:08 | 只看该作者
那楼上知道是什么标准吗

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6#
发表于 2011-6-21 15:20 | 只看该作者
IPC-7351

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7#
 楼主| 发表于 2011-6-21 15:50 | 只看该作者
IPC_7351中并没有关于Courtyard到底要多大的一个标准数值啊,好像只给了一个概念吧

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8#
发表于 2011-6-23 21:59 | 只看该作者
坐等回答
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