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时序等长的疑问?

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该用户从未签到

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1#
发表于 2008-5-27 14:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在小系统中
' C* j( F; S- R0 I/ x7 p要求DATA中的每根信号相等1 D& \7 F/ ^5 D( d! |
还是要求Data=address=clock?

该用户从未签到

2#
发表于 2008-5-27 16:15 | 只看该作者
如果能做到的话后者更好3 t1 o0 i: }( f% b3 \
毕竟数据,地址,时钟工作时是一个整体
  • TA的每日心情
    开心
    2023-5-11 15:04
  • 签到天数: 2 天

    [LV.1]初来乍到

    3#
    发表于 2008-5-28 10:26 | 只看该作者
    按理说,如果看clock沿操作的话,clock的信号要最早到
    ) A- U- S1 m9 w# x. Y. E- K8 v3 t5 E其次是address,看到地址信号,以后再取data9 o1 E+ ?; R% r. `) Y2 o

    ) t# I9 ~7 y2 F但事实非如此,因为clock,data,address的拓扑是不同的,而且data是双向的。并且在芯片封装内所采用管脚模型也不同。如果还有匹配的话,就差更多了。
    ) _2 e* K/ Q9 y$ Y  |4 q0 @* Z8 ], i/ D
    所以这3组之间不是简单的a=b=c等长关系,而是等长的逻辑等式.具体的要看你的芯片layout guide或者reference board.8 W* {% `* ~/ N! B9 O5 T7 d: l8 d
    1 \! q$ M1 Q( c* E+ `( ?
    如果都没有,就要做板仿了。

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    该用户从未签到

    4#
    发表于 2008-5-28 10:50 | 只看该作者
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    - q! x1 U7 v+ l; L$ I" H你搜下貼看看
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