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利用toolbox组件中的panelize进行PCB 拼版

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    发表于 2021-3-17 12:15 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    本帖最后由 heyan504538 于 2021-3-17 16:31 编辑 2 h" Y- i- u6 q( W0 P  b) `
    * E; s4 m) W+ `) G5 z5 _
    当前在PCB中直接进行拼版的话,用的比较多的方式是创建module,针对单个文件进行拼版的话该方式还是比较快捷好用,但是如果有多个文件需拼版,或者创建好拼版后需要优化,调整,修改的话,会比较麻烦。4 m& n' t# O. n2 N7 D+ b6 c
    最近研究了一下allegro的 productivity toolbox功能,其中就有关于拼版的功能panelize,但是网上针对这一功能的介绍比较少,在这里我就把自己摸索出来的方法共享出来了,英文好的,可以直接看官方的手册 Allegro拼版_panelize.pdf (1.81 MB, 下载次数: 60) + O" ?6 O2 h' |
    拼版步骤(提前导入拼版结构图,准备好):
      u; M/ d! |  n1 p1:勾选toolbox组件( P4 g/ E8 T: J
    9 ^6 A0 S7 }, w
    2:export techfile (主要包含一些设计规则信息)
    ' _5 v" ?0 H  T4 V' W  F1 q3:manufacture-----fab panelize tool,进入拼版设计界面" ^& n) h) i1 O3 O/ w1 M% Z

    : u9 l; u$ k5 _6 j' T% ?. p! W6 E(1):选择已设计好的PCB文件路径,如果需要对多个不同的PCB文件进行拼版的话,依次添加行,选择相应的路径即可;5 t/ ?9 L8 N8 x% m( ]
    3 }# ?8 C( W- k/ b
    勾选使用相关路径,即拼版文件存储在该路径下;
      @' P. g' H! i0 [$ F(2):设计/复制包含的层;
    , n3 u8 J) U0 s8 J9 Y8 ZALL: 所有的层,包括一些区域设计,ANTIEHCH等;此处勾选ALL) m6 j5 F7 q' |# }
    Artwork based:只有光绘层;* a3 j& n6 ]1 |( u% X  ]/ i9 f, S
    (3):设计过程: r* X8 E& x+ M; `& b
    exclude routing: 排除走线,即只复用器件布局;/ \2 K: H. t/ i) z0 l: y
    load artwork: 允许导入光绘类的数据(格式,单位,精度等)0 v; I: i& u+ o9 }  \) A* Q
    clear nets: 清除网络  _1 [% ~1 x& S7 N
    (4):此处设置主要是针对多个文件(层数需一致)进行拼版的话,需要同步叠层设置,包括叠层顺序,叠层名称等,选择一个为基准,单击同步。
    1 u) U: E" V0 u/ k6 O  O$ _(5):导入前面生产的techfile,导入设计规则
    ; J! q4 f$ e4 @! }2 B, B1 e(6):先点击创建module,再place* q% X) w4 J9 b9 X! N7 W, Q

    " c0 d8 K; k& `  ~此处可以对拼版文件进行旋转, 镜像,单独放置,或者矩阵放置(设计行列,偏移量)
    . ]; P" E7 n5 l. z: g5 V+ c* L
    0 [6 }: q* q8 _  {: ?) I
    8 Q. }4 M$ d# a/ |8 a6 z ( s& V6 F2 q$ w* g5 G) M: s
    * _* F7 o  ^# T+ I

    1 y1 x# D9 X8 i( I手动放置的话注意选好基准,放置完成后,此界面也可以显示放置拼版后的坐标等相关信息,可以再核查一遍,确认无误后单击OK完成。
    . F- i9 k3 o& ~) ] & f# {. _  W/ ]" ~
    需要注意的的有以下几点:- _. g2 g) K9 {4 {. }* l! \. T
    1:生成的拼版文件铜皮默认的是静态铜皮;
    + I  H1 N0 o* R2 M) a4 e/ S0 T2:区域规则需要重新赋值;
    ( G7 _% O5 p: A* @3:有rout keep in的话会产生报错,删除即可;9 x5 N7 Q% r! S* R+ o4 i; q
    4:位号丝印需要处理,会带有module的前缀,P1~,P2~,但是会产生新的丝印层,详见下图,位号丝印处理的方法很多,这里不再赘述。
      Y7 s8 T6 Z! j( Z5 L7 \ ! N2 |4 U+ P2 w; {7 G

    1 a9 u$ S8 G. R# c+ J" E5 ]. ~1 n5 `. n0 X9 j" J
    5:后期有器件更新或者其他更改的话,直接更新同步即可,这也是该方法比较方便的一点。
      h( ~+ t6 _8 j0 k* g6 }' e6 ]# @% u2 Q3 g/ Y/ y

    ) r. T$ [$ _7 K8 n% l. D: k以上有表述不对或者不清楚的欢迎大家留言,指正,大家共同探讨学习。$ f/ V& q% w: s+ ?3 V6 P
    $ P5 {/ Y9 w; h& F. J3 `

    8 }" ^0 r, j' \% Y$ m- T$ s

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    [LV.9]以坛为家II

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    发表于 2022-12-3 17:09 | 只看该作者
    感謝分享 這正是我需求的

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    发表于 2024-3-13 18:24 | 只看该作者
    厉害,找半天这种博客了

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