DDR走线问题

mylhp · 发表于 2021-3-11 16:33

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请问一样各位大神,DDR走线各位是否一定会按照 3W规则来布线？

tyantson · 发表于 2021-3-11 16:49

空间够的话就3W，其次2W

這侽孓譙悴丶 · 发表于 2021-3-11 22:48

数据线比地址线要严格，数据线3W是可以做到的，地址线空间比较紧张，尽量能做到的地方就做到3W，有些地方实在没空间的做不到也是可以接受的！

sandy.huang · 发表于 2021-3-17 14:04

看速率看空间看仿真结果，最好越远越好，但不一定满足

Mmzzyy · 发表于 2021-3-17 16:05

DQ线组内3H，DQS线组内5H，CLK组内5H，ADDR、CTRL组内3H。组间都是4H。非DDR6H。H为介质层厚度。

zyg1060482876 · 发表于 2021-10-21 09:40

学习

max192 · 发表于 2021-10-21 10:45

空间够的话就3W

why_not · 发表于 2021-10-22 11:32

空间够的话就3W，其次2W

敢敢 · 发表于 2021-10-22 13:52

:lol:lol:lol:lol:lol:lol:lol:lol:lol:lol

dengyuan1991 · 发表于 2021-10-22 18:36

能做到就最好罗，不行就2W

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