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pads 原理图PCB常见错误及DRC报告网络问题1 U, x8 u8 _1 O/ q- b$ e
1.原理图常见错误：
. U. [3 H- T/ Y. D （1）ERC 报告管脚没有接入信号：7 w7 b6 t) k. s3 o: i! u/ w! Y
a. 创建封装时给管脚定义了 I/O 属性；
( c K& o2 K5 s; H b.创建元件或放置元件时修改了不一致的 grid 属性，管脚与线没有连上；
. H( ? M( U$ u' g' @ c. 创建元件时 pin 方向反向，必须非 pin name 端连线。
- i( G8 y: e) H4 w9 a5 Z* |) J3 H（2）元件跑到图纸界外：没有在元件库图表纸中心创建元件。9 N" s% Y7 F7 U# L/ c) P, E' r3 D
（3）创建的工程文件网络表只能部分调入 pcb：生成 netlist 时没有选择为global。
# Z( a2 L0 O: d3 s, {（4）当使用自己创建的多部分组成的元件时，千万不要使用 annotate. ) s9 o$ r& J* f7 t; Q
, T" j1 ~. K& t$ E
) H& e; I. q, E
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发表于 2021-2-1 18:07
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