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电路设计时怎样减少静电放电对线路的损坏

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发表于 2020-10-28 10:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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电路设计时怎样减少静电放电对线路的损坏1 ], B) W" j. N$ f; f7 |* }7 g

' b$ H* M0 v- o  P& U1)尽量使用屏蔽电缆, Y0 Y" F6 m6 H) c* Z& s
2)在接口处安装滤波器% |  t+ z; ~7 c/ w3 N+ d0 I
3)将无法安装滤波器的敏感接口加以隔离
5 J1 ^! R! C# \* S7 Q4)给有关电路设置接地保护
6 I/ m+ v, m" y$ k5)选择低脉冲的频率的逻辑电路; N5 c( Z( I9 A! o
6)保持地电流远离敏感的电路及有关线路。% ?, @5 G, S% j

该用户从未签到

2#
发表于 2020-10-28 10:57 | 只看该作者
楼主说的这几点确实很关键。
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