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电路设计时怎样减少静电放电对线路的损坏

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发表于 2020-10-28 10:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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电路设计时怎样减少静电放电对线路的损坏3 P7 m. i  e& T0 l

( l' y& @) z0 l0 j1)尽量使用屏蔽电缆( B$ R  B1 `7 M9 a- q* B* g
2)在接口处安装滤波器2 G$ b% }4 D7 {8 c) M4 G
3)将无法安装滤波器的敏感接口加以隔离
$ x9 ^5 N( `2 {6 S* b0 F$ F5 T4)给有关电路设置接地保护
" x: W  R; v( Y5)选择低脉冲的频率的逻辑电路
" `& }, t) M" w5 S: t# ]- v6)保持地电流远离敏感的电路及有关线路。
) |( @6 j' u* U1 L8 y4 I

该用户从未签到

2#
发表于 2020-10-28 10:57 | 只看该作者
楼主说的这几点确实很关键。
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