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[Cadence Sigrity] 【Sigrity DDR4信号仿真问题】

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  • TA的每日心情
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    2020-12-22 15:09
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    [LV.4]偶尔看看III

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    1#
    发表于 2020-9-22 15:55 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    用SystemSI跑DDR4信号仿真,输出结果看波形的时候,有Waveform,Eye Contour和BER,这三个看上去都是眼图,但是有什么区别?
    5 h2 U/ {4 e" n, y! r# b还有个问题,如何在得出的波形上进行测量眼宽?1 A1 n" Z: Z0 T" y. l- w
    太难了* m" O+ O! l# D
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    [LV.8]以坛为家I

    推荐
    发表于 2020-9-22 17:58 | 只看该作者
    Waveform原始波形. [  F% B2 h& T* Y) H+ H/ b2 A
    Eye Contour眼图轮廓
    , p) p' E" P; N0 ?; [: |) nBER误码率眼图

    点评

    谢谢阿杜大佬!  详情 回复 发表于 2020-9-22 18:55

    该用户从未签到

    2#
    发表于 2020-9-22 16:31 | 只看该作者
    信号不一样吧
  • TA的每日心情
    开心
    2020-12-22 15:09
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    [LV.4]偶尔看看III

    4#
     楼主| 发表于 2020-9-22 18:55 | 只看该作者
    dzkcool 发表于 2020-9-22 17:58
    5 }: }7 ]8 n) F6 m. a# ]Waveform原始波形( @% K' k0 ]& E& V
    Eye Contour眼图轮廓8 s+ {4 g" n7 {( `3 R% u
    BER误码率眼图

    9 ~, `8 m& d0 I- y' [4 T谢谢阿杜大佬!
    - J" ~: `/ s8 d  X
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    [LV.4]偶尔看看III

    5#
     楼主| 发表于 2020-9-23 11:02 | 只看该作者
    还有个问题,ODT模式选择的不对,Write模式下低电平会被拉高么?
    1 Z2 _( Q' L# m1 P) j6 [我仿真出来DDR4的Write模式,低电平都被抬到了0.55左右,如下图:
    , ^6 e- _( Z- |0 a# m& M# j8 K& G3 ^
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    [LV.8]以坛为家I

    6#
    发表于 2020-9-23 11:31 | 只看该作者
    ODT就是端接,会改变接收端信号幅度

    点评

    杜老师好,那判决电平的高低也会动态改变么?还是依旧是0.6为中心?  详情 回复 发表于 2020-9-23 14:08
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    [LV.4]偶尔看看III

    7#
     楼主| 发表于 2020-9-23 14:08 | 只看该作者
    dzkcool 发表于 2020-9-23 11:311 V/ d. D8 {: r: {
    ODT就是端接,会改变接收端信号幅度
    " Y8 H) D" k% j* P8 g% v- a! O& x
    杜老师好,那判决电平的高低也会动态改变么?还是依旧是0.6为中心?7 d7 p* D1 Y5 X) T8 n
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    [LV.4]偶尔看看III

    8#
     楼主| 发表于 2020-9-23 15:01 | 只看该作者

    3 j' d' D+ l. J; T4 c" e. k图片是DDR的规格书,里面这里说的是不是 VREF不是固定的,是由眼图中间最宽的点决定,这个具体由Ron和ODT设置决定高低电平?, X5 ^  A2 w9 l1 m8 J: H

    2020-9-23 15-00-05.jpg (66.87 KB, 下载次数: 0)

    2020-9-23 15-00-05.jpg
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    9#
    发表于 2020-9-23 18:02 | 只看该作者
    DDR4的会动态改变
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