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求助OrCAD Capture CIS 16.3生成网络表的问题

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1#
发表于 2010-3-15 12:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 zjf2010 于 2010-3-18 17:01 编辑
& @& y; z3 r+ f8 i6 W- c
8 ?6 W! N5 Z0 y, {4 K$ o我是一个新手,怎么就生成不了网络表呢?出现图的情况!麻烦高手帮帮忙!
0 S: }0 |+ o0 ]- c* f, ?3 E% E, z8 u* |4 W* i

4 P8 U  r. t) C7 b日志描述:
+ w! F9 o$ }7 Q) M+ x! V2 dSpawning... "F:\cadence\SPB_16.3\tools\capture\pstswp.exe" -pst -d "f:\pbc\mysch\mysch\myproj.dsn" -n "f:\pbc\mysch\mysch\allegro" -c "F:\Cadence\SPB_16.3\tools\capture\allegro.cfg" -v 3  -w -l 31 -s "" -j "PCB Footprint"6 k1 c5 [; s. U$ j  L+ k
#1 Error   [ALG0083] Conflicting values of "PCB Footprint" found on component instance U6D: SCHEMATIC1, DSP_decoupling (71.12, 43.18) .3 e4 {3 _( E7 S2 B
#2 Aborting Netlisting... Please correct the above errors and retry.

12.jpg (12.11 KB, 下载次数: 6)

为什么出现这个呢?

为什么出现这个呢?

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2#
发表于 2010-3-17 16:10 | 只看该作者
你要看看日志里面怎么描述错误的,贴上来别人才能帮你。

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3#
 楼主| 发表于 2010-3-18 17:00 | 只看该作者
你要看看日志里面怎么描述错误的,贴上来别人才能帮你。$ Q  T/ D* o: z, o5 V3 L+ Y
killerljj 发表于 2010-3-17 16:10
& v+ q; K8 ^# S0 p$ m

# @/ e6 [0 B( D6 J" l8 l$ U' [: L, T! S4 {
    谢谢

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4#
发表于 2010-3-20 10:56 | 只看该作者
U6D没有指派PCB封装

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5#
 楼主| 发表于 2010-3-20 11:56 | 只看该作者
U6D没有指派PCB封装. S1 O5 }! b/ t! U8 G+ i& ]9 q
tuzhiquan 发表于 2010-3-20 10:56
$ L7 G6 r' M) t' P2 t
5 T' t' S8 o9 H# P5 i
, c- u% _5 U0 p; c! d4 V: w
   非常感谢,我是整体修改封装,把它的封装写成电容了。看来以后还是小心才行啊
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