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1#
发表于 2010-1-30 20:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
本帖最后由 xxb 于 2010-1-30 20:33 编辑
4 X# i: }' V: J! D3 R  m! A1 A& }$ g3 x' p8 |+ Q& l8 a
生成网表时提示下面的错误7 C) m1 _+ Q* ~1 n5 j
是什么意思啊?
* J- G- g& k! k* ]. K5 X谢谢!8 j6 Q; _) {# q% Z7 ]  F
[FMT0003] Duplicate pin U7 pin 16. Possibly a complex hierarchy in logical view or duplicate part reference in physical view.9 J' q0 n6 A, s: J% K3 L
[FMT0018] Errors processing intermediate file

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2#
发表于 2010-1-31 21:41 | 只看该作者
U7的pin脚冲突了?
" e0 u5 y: y# U" h! H: e" TDRC有没有做过?

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3#
 楼主| 发表于 2010-2-3 16:02 | 只看该作者
DRC没有做过
& K7 j- ^% R, z" H3 `4 T! v6 R问题解决了
/ o! e: @) P) r) N+ W谢谢楼上

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4#
发表于 2010-2-3 21:24 | 只看该作者
如果楼主能把怎么解决问题的方法发出了就好了,
/ S7 q( |. @& d& v$ A- z让大家都学习一下。

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5#
 楼主| 发表于 2010-2-3 22:44 | 只看该作者
回复 4# ger11 2 T/ N% R( p2 D+ t

% W3 x( D+ c' L- [$ q5 L
- j; c" @9 \1 S4 c; D/ Z3 K2 n# Y, a    如1楼所说,生成网表前没有做DRC检查,原理图中元件名重了(两个U7),改过之后没错了。
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