【EDA365首届PCB设计大赛】之【68号作品】

kakala

对于4层板有些疑问，DDR走在第3层，阻抗如何控制，BOT层的DDR参考第3层也就不完整，有没有这么做过的打板回来测试稳定性如何，如果OK，后面做项目时可以考虑这么做咯

花花999

好作品，必须得支持！

夜将白

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小奶猫

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457958672

kakala 发表于 2019-11-29 11:22
对于4层板有些疑问，DDR走在第3层，阻抗如何控制，BOT层的DDR参考第3层也就不完整，有没有这么做过的打板回 ...

  t7 p) R& n' ~. \4层板对贴的很多，盒子上面有的平台DDR4 能上2666，第三层和第四层的地址线都会采用每两根走线包地或者电源  以提供回流最短回流路径，楼主这不包地或电源 估计频率上不去

Colbyzn

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Colbyzn

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爱在边缘

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Shaosiyu333

457958672 发表于 2019-11-29 14:17:37
/ Q& V# b+ o/ R' d* [: E[quote]kakala 发表于 2019-11-29 11:22
对于4层板有些疑问，DDR走在第3层，阻抗如何控制，BOT层的DDR参考第3层也就不完整，有没有这么做过的打板回 ...

; j: j: I! ]) O4层板对贴的很多，盒子上面有的平台DDR4 能上2666，第三层和第四层的地址线都会采用每两根走线包地或者电源  以提供回流最短回流路径，楼主这不包地或电源 估计频率上不去
[/quote]
" w7 e* }0 Z* e( R0 o# Q* c$ V1 F
5 R/ i: a" D- f/ T0 U9 e是的 应该包地的 直接同层参考就好了 想的少了 多谢大神指教～

$ `8 a& l8 a9 x+ O; {0 r

kakala

457958672 发表于 2019-11-29 14:17
4层板对贴的很多，盒子上面有的平台DDR4 能上2666，第三层和第四层的地址线都会采用每两根走线包地或者电 ...

1 G) @1 l1 f7 [谢谢分享经验

王小白

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457958672

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457958672

Shaosiyu333 发表于 2019-11-29 14:42
. x* p1 Z$ l- S! t- c* |4层板对贴的很多，盒子上面有的平台DDR4 能上2666，第三层和第四层的地址线都会采用每两根走线包地或者电 ...

, g) z+ @2 s+ o+ l6 N原作者出现，你们才是大神，貌似这些作品里面就你的是四层板，其他的都是6层  还有8层的，必须支持一下

长念

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Shaosiyu333

457958672 发表于 2019-11-29 16:09:39
7 v3 Y  E7 @. x. q, ?6 S2 c[quote]Shaosiyu333 发表于 2019-11-29 14:42
4层板对贴的很多，盒子上面有的平台DDR4 能上2666，第三层和第四层的地址线都会采用每两根走线包地或者电 ...

' h& s5 r* Z- j9 I8 N原作者出现，你们才是大神，貌似这些作品里面就你的是四层板，其他的都是6层  还有8层的，必须支持一下
! Z) u5 |% Q  z- M' T( t+ T, L[/quote]
$ F$ Z/ N& n# a' E3 U
唉～抠抠嗖嗖公司出来的 成本抓的严啊～不过跟大神学到了 嘻嘻

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