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楼主: 行者~ABC
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搞懂“上拉电阻”,就这么快?

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该用户从未签到

676#
发表于 2022-9-18 20:09 | 只看该作者
  • TA的每日心情
    开心
    2024-4-17 15:33
  • 签到天数: 354 天

    [LV.8]以坛为家I

    677#
    发表于 2022-9-20 14:38 | 只看该作者
    学习学习学习学习

    该用户从未签到

    679#
    发表于 2022-9-22 18:01 | 只看该作者
    学习下!好好看一下$ [! T+ p/ R# P3 m- ]% ~9 w

    该用户从未签到

    680#
    发表于 2022-9-22 18:02 | 只看该作者
    学习下!好好看看

    该用户从未签到

    681#
    发表于 2022-9-28 15:22 | 只看该作者
    333333333333333333333
    - B1 K; w4 a+ c, i  S

    该用户从未签到

    682#
    发表于 2022-10-31 17:45 | 只看该作者

    该用户从未签到

    683#
    发表于 2022-11-16 16:19 | 只看该作者
    多谢大神的讲解 好好看看
    & A9 ~( \2 K" x) j% J
  • TA的每日心情

    2025-8-25 15:00
  • 签到天数: 572 天

    [LV.9]以坛为家II

    684#
    发表于 2022-11-16 16:25 | 只看该作者
    xxxxxxxxxx

    该用户从未签到

    685#
    发表于 2022-12-19 15:19 | 只看该作者
    学习学习学习学习
  • TA的每日心情
    开心
    2022-12-20 15:40
  • 签到天数: 2 天

    [LV.1]初来乍到

    686#
    发表于 2022-12-19 19:00 | 只看该作者
    上拉和下来电阻在很多场合用得的确非常多啊!  u# \  D( J; n  X
    上拉电阻的作用:在CMOS芯片上,为了防止静电造成损坏,不用的管脚不能悬空,一般接上拉电阻以降低输入阻抗, 提供泄荷通路。芯片的管脚加上拉电阻来提高输出电平,从而提高芯片输入信号的噪声容限,增强抗干扰能力;提高总线的抗电磁干扰能力,管脚悬空就比较容易接受外界的电磁干扰。
    3 Y5 x4 E$ d. Z: O4 I9 w下拉电阻的作用:提高芯片输入信号的噪声容限:输入端如果是高阻状态,或者高阻抗输入端处于悬空状态,此时需要加上拉或下拉,以免收到随机电平而影响电路工作。% {) q5 b' p  h3 a6 `) P* ^
    ( s! Z. j, b  v& `
    同样如果输出端处于被动状态,需要加上拉或下拉,如输出端仅仅是一个三极管的集电极。从而提高芯片输入信号的噪声容限增强抗干扰能力。
    % i9 o# p9 J1 {1 ^
    : s/ d8 l% T7 C) {关键还有上拉和下拉电阻的选择
  • TA的每日心情
    开心
    2025-10-2 15:03
  • 签到天数: 870 天

    [LV.10]以坛为家III

    687#
    发表于 2022-12-21 15:04 | 只看该作者
    看看大佬怎么说

    该用户从未签到

    688#
    发表于 2022-12-21 18:29 | 只看该作者
    555555555555555555
    . \  O8 `/ b9 D+ p% s# O0 k2 \
  • TA的每日心情
    郁闷
    2023-12-13 15:44
  • 签到天数: 5 天

    [LV.2]偶尔看看I

    689#
    发表于 2022-12-22 16:49 | 只看该作者
    学习一下,谢谢! K" k1 p$ B# T  d
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