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RGMII PCB 设计规则

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    发表于 2019-8-12 20:41 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    RGMII  PCB 设计规则; D1 f. Y  r8 l- q+ d
    rgmiiPCB设计规则.pdf (67.32 KB, 下载次数: 90)
    / e' \& y' |3 a2 B9 s' q

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    jacky401 + 3 感谢分享!

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    发表于 2019-8-15 09:28 | 只看该作者
    电气特性: RGMII(version 1.3)接口工作电平为 2.5VLVCMOS, RGMII(version 2.0)工作于 1.5VHSTL 接口电平上。7 C" s: j, a: J PCB 设计原则:1 O- j8 i2 V5 t! h" {+ H& h/ f 总原则: 1.各信号线的阻抗控制在 50 欧姆。: m. L& ?8 |1 O9 y 2.组内信号长度差不超过 100mil。 3.尽量不要跨层和电源,地分割线。 发送部分:6 d: C% W- E4 b6 v" Y' w 1.发送数据线 TXD{0:3},TXCTL 等长。4 @* o1 K9 ^2 ^9 z- c 2.发送时钟 TXC 尽量和发送数据线 TXD{0:3},TXCTL 等长。(器件具有内部延时功能)$ k+ ?1 \2 s- O/ D: W 接受部分: 1.接受数据线 RXD{0:3},RXCTL 等长。 2.接受时钟 RXC 尽量和发送数据线 RXD{0:3},RXCTL 等长。(器件具有内部延时功能)8 e0 d6 u  `2 K0 r& b4 _ 器件不带内部延时功能的,在设计中要求从驱动端到接收端的时钟线要在 pcb 上做绕线延时,时间大约 1.5ns-2.0ns

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    发表于 2019-8-13 08:55 | 只看该作者
    《RGMII PCB设计规则》文档内容
    - S, n! C% T. B; j/ @

    # u, ], d6 j; Z' G" N5 b$ ?* k  T一、电气特性:
      m  [6 K3 i- I8 X- [0 PRGMII(version 1.3)接口工作电平为 2.5VLVCMOS,0 Z& Y. U' I0 L) l2 p7 Q3 C
    RGMII(version 2.0)工作于 1.5VHSTL 接口电平上。
    6 P  c7 T5 D  Z( O
    & G! C5 J& i% U$ x' E二、PCB 设计原则:" O8 V8 C. l5 q0 b
    2.1、总原则:
      l3 P. X2 c8 c) O1.各信号线的阻抗控制在 50 欧姆。% [4 S5 S# [( @4 @" w5 L
    2.组内信号长度差不超过 100mil。
    9 a" I4 j4 U2 h! ?- ]; |3.尽量不要跨层和电源, 地分割线。. ?0 S4 x+ N; G. [. @. g

    4 J& \% [. T4 u* J& x/ T# ?7 v5 c2.2、发送部分:( I0 J# S* t  k9 ]* L; ^) Q0 e. ?! a
    1.发送数据线 TXD{0:3}, TXCTL 等长。
    ) s. R/ `* a( b* H2.发送时钟 TXC 尽量和发送数据线 TXD{0: 3},TXCTL 等长。 (器件具有内部延时功能)
    * F5 x  K" h6 r- B( S& y: b  w1 `$ w) U- L8 l+ q  F/ d  Y# T0 k
    2.3、接收部分:: ~0 H7 @9 A9 n7 ^9 s; j
    1.接受数据线 RXD{0:3}, RXCTL 等长。
    * I7 {4 Q' N1 ^2.接受时钟 RXC 尽量和发送数据线 RXD{0: 3},RXCTL 等长。 (器件具有内部延时功能)
    3 v* m2 {- Z, ?5 i$ S器件不带内部延时功能的, 在设计中要求从驱动端到接收端的时钟线要在 pcb 上做绕线延时, 时间大约 1.5ns-2.0ns/ Y  C1 O* g6 F- n. L

    9 R, ]9 o5 N5 w

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    4#
    发表于 2019-8-13 09:38 | 只看该作者
    电气特性:- @: R. f0 d" a! }
    RGMII(version 1.3)接口工作电平为 2.5VLVCMOS,
    ( P) X. }! e6 Y; ZRGMII(version 2.0)工作于 1.5VHSTL 接口电平上。
    - L9 |$ \- Z( i* E# k$ ], UPCB 设计原则:% \, h9 U8 i# a
    总原则:& Q$ ~2 e% |4 `  A& `  f6 S! E
    1.各信号线的阻抗控制在 50 欧姆。
    * L2 w6 X- Z# @, K5 s7 i7 v2.组内信号长度差不超过 100mil。
    ; c* }, T( J! K- z1 ~2 Z3.尽量不要跨层和电源,地分割线。% D# c; K7 T$ B6 {, j
    发送部分:
    ; d* Q4 [2 F0 K! M, l1.发送数据线 TXD{0:3},TXCTL 等长。2 ^  g" @0 n: g# B% o  a
    2.发送时钟 TXC 尽量和发送数据线 TXD{0:3},TXCTL 等长。(器件具有内部延时功能)( Y  t- z" u, H
    接受部分:
    * y# [: a( m9 B/ G8 K1 ]( m7 U" ^1.接受数据线 RXD{0:3},RXCTL 等长。  f% _% i* I: N) H1 }9 K: P* t
    2.接受时钟 RXC 尽量和发送数据线 RXD{0:3},RXCTL 等长。(器件具有内部延时功能)* [/ X, i8 o  D( W, ^6 n0 _2 I3 X
    器件不带内部延时功能的,在设计中要求从驱动端到接收端的时钟线要在 pcb 上做绕线延时,时间大约 1.5ns-2.0ns

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    6#
    发表于 2019-8-13 10:39 | 只看该作者
    做人要有良心

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    8#
    发表于 2019-8-13 14:42 | 只看该作者
    以太网接口的阻抗不是100欧姆吗?

    点评

    我说的是RGMII,不是RJ45  详情 回复 发表于 2019-8-13 15:01
  • TA的每日心情
    开心
    2020-3-4 15:24
  • 签到天数: 1 天

    [LV.1]初来乍到

    9#
     楼主| 发表于 2019-8-13 15:01 | 只看该作者
    xiaoxiaozhou 发表于 2019-8-13 14:420 t. M) H" \1 m/ K9 F( j! _/ p
    以太网接口的阻抗不是100欧姆吗?
    . \+ V" q1 X! Z( a' r9 i* E8 O" h
    我说的是RGMII,不是RJ45
    . {9 Z' d) H3 h0 u; _! e

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    10#
    发表于 2019-8-13 16:55 | 只看该作者
    做人要有良心,就几句话,你做成一个pdf,上来赚积分?你直接把这几句话复制粘贴就好了。

    点评

    嗯嗯,初次使用,不好意思。这个积分我得不到。下面已经粘贴出来了你没看见么?  详情 回复 发表于 2019-8-13 17:27
  • TA的每日心情
    开心
    2020-3-4 15:24
  • 签到天数: 1 天

    [LV.1]初来乍到

    11#
     楼主| 发表于 2019-8-13 17:27 | 只看该作者
    宝庆书生 发表于 2019-8-13 16:55
    9 K! Q5 O5 B2 c9 t1 D5 n9 o( H" L做人要有良心,就几句话,你做成一个pdf,上来赚积分?你直接把这几句话复制粘贴就好了。

    ; N$ T5 U3 w5 e2 f& A& ~嗯嗯,初次使用,不好意思。这个积分我得不到。下面已经粘贴出来了你没看见么?6 s; |1 f8 l# f6 V8 g9 X; P

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    13#
    发表于 2019-8-15 09:13 | 只看该作者
    不错,值得学习!

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    15#
    发表于 2019-12-12 15:04 | 只看该作者
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