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EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › Altera FPGA 开发过程中sof、pof、jic文件的区别（1）
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Altera FPGA 开发过程中sof、pof、jic文件的区别（1）

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pulbieup

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发表于 2019-6-10 10:12 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1、sof文件
! J: E4 I% p: t3 x1 p9 r  r9 g! u: r- B
6 @2 {, }% Q- P" V( D, t
sof文件是编译（分析、综合、布线、生成、时序）过程中生成的一个文件，如下图红圈过程中所示，8 R% ~' E7 F. [( L4 C
# U5 |5 t* q+ L( X- l+ B
6 j: B2 Z2 m2 g( I4 @
( h8 [6 ]; {; q- ?% g
9 ^# ?) |  f% w2 V- C
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    [LV.1]初来乍到
    3#
    发表于 2019-6-10 16:20 | 只看该作者
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