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使用signaltapII调试FPGA设计中的bug

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发表于 2019-6-5 13:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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FPGA的资源是有限的。
. N) Q# l7 r7 f2 C- Y& J+ r
      设计已经占用了可观的资源(%的LE,%的MB),signaltap还要和设计抢占资源。“抢占”在这里是很贴切的,既包括抢占LE、MB,还包括布局资源和布线资源。我把“抢占”造成的影响叫做“测不准原理”。这一原理是贯穿signaltap调试始终的一条基本原理。一句话来说,就是“对信号的观察会引入对信号的影响”。
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发表于 2019-6-5 16:28 | 只看该作者
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