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[Cadence Sigrity] 请教关于SQ中的串扰仿真!!!!

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1#
发表于 2009-5-19 20:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
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2#
发表于 2009-7-13 10:33 | 只看该作者
这个也是我很想知道的问题。

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3#
发表于 2009-7-13 12:19 | 只看该作者
嗯,高手回答一下吧
  • TA的每日心情
    开心
    2019-12-3 15:20
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    4#
    发表于 2009-7-13 14:41 | 只看该作者
    (1)你说得没错,不能提取。- ]* r. @. m7 I6 [3 t
    (2)耦合长度是在PCB里量出来的。( Q$ x5 z# o# b) ^1 ~# H! L
    (3)耦合间距和其它参数可以在模型里自行设置,如下图:5 r& Z" P5 V1 [, {$ e
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    5#
     楼主| 发表于 2009-7-15 18:03 | 只看该作者
    提示: 作者被禁止或删除 内容自动屏蔽

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    6#
    发表于 2009-9-1 11:53 | 只看该作者
    恩  原來是這樣~  感謝分享資訊

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    7#
    发表于 2010-5-28 08:50 | 只看该作者
    那我想要把串扰的电气约束条件应用到PCB中,接反应出来,那不是也不行?

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    8#
    发表于 2011-4-20 19:38 | 只看该作者
    本帖最后由 xicz 于 2011-4-20 19:39 编辑
      C$ n! B" l/ t; u% y
    9 ^0 z4 p' O& g0 ~& q我也是直接在SigXplorer里面搭个耦合传输线,其实串扰也就线宽、线长、间距这几个重要参数,自己设一下就行了。
    : K) w( J! n& A- r5 d. c要不就导入到siwave里面仿,不过导的过程中很容易出问题。" w2 l+ X8 a) k0 T# @# y% [1 d( X

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    9#
    发表于 2011-5-13 10:49 | 只看该作者
    学习了

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    10#
    发表于 2011-8-16 19:26 | 只看该作者
    郁闷的是我看不到图片。。
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