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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › Cadence Allegro教程资料区 › 一步步实现DDR布线
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楼主: xiaoxiaozhou
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一步步实现DDR布线

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shelly9425

该用户从未签到
33#
发表于 2019-5-14 14:23 | 只看该作者
强大，很实用也很常用的部分

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why_not

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34#
发表于 2019-5-14 14:52 | 只看该作者
强大，很实用也很常用的部分

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kully

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36#
发表于 2019-5-14 15:28 | 只看该作者
看看DDR的介绍。
: R9 P5 W, T  ]. {$ q5 c4 X$ e3 q6 C) F1 c

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kully

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38#
发表于 2019-5-14 15:33 | 只看该作者
大致看了下，只是单纯从Pcb Layout的角度分析。
$ J( Y1 w$ p3 [3 ]' Q$ D, ~# h/ g如果加上前仿，后仿，PI，各个角度去分析，生成约束规范，更好。

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bingshuihuo

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42#
发表于 2019-5-14 17:13 | 只看该作者
# `! h; `5 B# N3 t6 _+ f+ p* \5 {
强大，很实用也很常用的部分

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lala8877
  • TA的每日心情
    开心
    2025-9-5 15:00

    • 签到天数: 69 天

    [LV.6]常住居民II
    45#
    发表于 2019-5-14 19:25 | 只看该作者
    學習中,謝謝！

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