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楼主: Allevi
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华为FPGA设计规范

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该用户从未签到

31#
发表于 2021-4-1 16:53 | 只看该作者
目测积分已经不够下载了@master
0 ]7 n* D: P" ^% h& p0 K: f

该用户从未签到

32#
发表于 2021-4-1 22:25 | 只看该作者
-------------------------------------6 ^) _0 f1 e$ L& P
  • TA的每日心情
    奋斗
    2025-7-2 15:40
  • 签到天数: 704 天

    [LV.9]以坛为家II

    33#
    发表于 2021-4-13 16:07 | 只看该作者
    学习看看先

    该用户从未签到

    34#
    发表于 2021-5-21 14:03 | 只看该作者
    华为FPGA设计规范,我这边看不到,怎样才能看得到
    2 o9 E; N' I+ T

    该用户从未签到

    35#
    发表于 2021-5-25 13:55 | 只看该作者
    原理还是PCB规范?

    该用户从未签到

    36#
    发表于 2021-5-25 15:54 | 只看该作者
    QQQQQQQQQQQQQQQQQQQQQQQQ  a3 I$ x5 g! {$ n  j% Y1 ~
  • TA的每日心情
    开心
    2020-3-4 15:24
  • 签到天数: 1 天

    [LV.1]初来乍到

    38#
    发表于 2021-5-31 15:18 | 只看该作者
    666666666666666
  • TA的每日心情
    奋斗
    2024-1-17 15:33
  • 签到天数: 23 天

    [LV.4]偶尔看看III

    39#
    发表于 2021-5-31 16:48 | 只看该作者
    学习学习学习学习学习学习; m6 y% U+ v3 q6 D

    该用户从未签到

    41#
    发表于 2021-6-8 16:39 | 只看该作者
    如果对转换后的原理图进行修正得整个原理图从头到尾彻底检查一遍,这个工作量以及存在的风险对于我们layout工程师和硬件工程师来说可能都不太现实,如果能将AD或Power Logic原理图产生的网表转成Allegro格式的网表,那就能导入Allegro里面设计了,就不需要转换原理图了,省又省时,这是最为简单方便又靠谱的方法了。9 d/ I
    ' d# ~" o! k8 V" d6 M: d
  • TA的每日心情
    擦汗
    2021-8-14 15:02
  • 签到天数: 6 天

    [LV.2]偶尔看看I

    42#
    发表于 2021-6-17 19:28 | 只看该作者
    学习一下,谢谢分享
    $ w6 z' |. q* c( n# u5 ^

    该用户从未签到

    45#
    发表于 2021-6-29 08:13 | 只看该作者
    谢谢分享,好好学习1 ]/ J1 Y& C. Q7 ]) @8 B* w4 g
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