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与门输入端不能加RC delay?

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  • TA的每日心情
    无聊
    2023-9-5 15:54
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    [LV.1]初来乍到

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    1#
    发表于 2018-10-31 19:44 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    今天遇到一个问题,就是与门 输入前,如果加RC delay,RC值太大的话 会导致输出震荡; 这种情况是不是没法仿真?% }% O" v- A! c

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    该用户从未签到

    推荐
    发表于 2018-11-2 09:01 | 只看该作者
    funeng3688 发表于 2018-11-1 14:32
    / l7 O( c* S% R) _* M+ I世上本没有模拟电路与数字电路区分。/ r7 P7 Z& ?% K
    比如一个三极管9014,有三个状态,截止、饱和、放大状态。设置好工作 ...

    1 t4 e' \4 Z( x, x: P6 l版主暴躁了,我觉得说的非常好
    " |0 Z9 m, M8 K( y

    该用户从未签到

    2#
    发表于 2018-10-31 22:11 | 只看该作者
    数字逻辑器件都存在 高低电平门限,以及不确定区间,SN74LVC1G08这种LVC系列的在3.3V供电的时候高电平应该是2V左右,低电平貌似0.7左右,而这两个中间状态就是芯片也不能保证的状态了,从图上看输入一个是H固定的,一个是PG3.3V缓慢上升,刚好在1.6V左右的时候发生了不稳定,属于非稳态,任何逻辑器件都不建议工作在这种状态下,虽然不会损坏。尤其是你还在这个非稳态停留了很长时间。你为什么要加RC?如果是要延时,可以RC+三极管之类的,就不存在明显的非稳态。

    点评

    事实上,我看到很多的图纸,像EN管脚都是直接用RC来做延时的...  详情 回复 发表于 2018-11-1 10:29

    该用户从未签到

    4#
    发表于 2018-11-1 10:29 | 只看该作者
    kevin890505 发表于 2018-10-31 22:11& F3 A) M6 j4 H  O, }. s
    数字逻辑器件都存在 高低电平门限,以及不确定区间,SN74LVC1G08这种LVC系列的在3.3V供电的时候高电平应该 ...

    % i& M) R9 U  F0 b/ u5 ?1 ]6 u6 F事实上,我看到很多的图纸,像EN管脚都是直接用RC来做延时的...4 y  n# O/ S( \4 K. B( ?% y: D' H

    点评

    谢谢分享!: 5.0
    这肯定了撒,最低成本的方案。但如果里面是数字电路,还是要出现非稳态。 这两个并不矛盾,你不关心这个非稳态自然无所谓,因为电路边沿再快,也是要有一段时间处于这个状态的,只是时间长短而已,时间久了,表现  详情 回复 发表于 2018-11-2 09:45
    谢谢分享!: 5
    那你的問題是什麼?那個異常有何影響?^_^  发表于 2018-11-1 22:58

    该用户从未签到

    5#
    发表于 2018-11-1 14:32 | 只看该作者
    世上本没有模拟电路与数字电路区分。4 q1 j+ a0 m* I
    比如一个三极管9014,有三个状态,截止、饱和、放大状态。设置好工作点,再加上直流负反馈,就是一个放大器,也就是模拟电路;如果没有负反馈,而且输入很强的电平信号0或者1,可能导致三极近截止或饱和,就变成了开关管,就是数字电路。
    $ M5 o4 w/ c  v9 w" Z再举个例子,同样的运算放大器LM324,纯粹是一个模拟电路,可以当做比较器使用(虽然输入的是两个模拟信号,但经过比较器之后,就只输出电平信号0和1),我甚至将LM324接成一个双稳态触发器,这是明摆着是数字逻辑电路。9 x+ }7 q& D9 g' r/ }
    讲了这么多,想说的是:与非门本质上是个模拟放大电路。如果输入是正常的电平信号0和1,这个与非门就只能输出0和1电平,表现为数字逻辑电路。但楼主输入是却是RC充放电信号,可能短时间会出现不是0也不是1的模拟信号,输出信号当然就会出现异常抖动。9 Y8 \# {. n5 S8 U
    我想不通的是,楼主为何会选择10K+10uF这样的参数,因为时间常数0.1秒,充放电实在是太慢了。什么样的电路需要这么强的滤波效果?' {9 K( d) @2 o/ l; O  Q, N; [
    如果外界干扰实在是太强了,需要这么慢的充放电时间,需要这么强的滤波效果,那么就采用带有施密特特征的与非门电路。
    " I) I" V5 ?( @# K0 hTMD,一堆废话。只有最后一句话才有点用处。

    点评

    版主暴躁了,我觉得说的非常好  详情 回复 发表于 2018-11-2 09:01

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    7#
    发表于 2018-11-2 09:45 | 只看该作者
    Joen0_0 发表于 2018-11-1 10:29! w3 F8 C) Z! m  y/ H5 U
    事实上,我看到很多的图纸,像EN管脚都是直接用RC来做延时的...
    0 v) L) I, a7 ~4 z3 p1 c" e
    这肯定了撒,最低成本的方案。还是要出现非稳态。    这两个并不矛盾,你不关心这个非稳态自然无所谓,因为电路边沿再快,也是要有一段时间处于这个状态的,只是时间长短而已,时间久了,表现的会很明显罢了

    点评

    是的,非常同意上面版主说的,非常到位,本没有数字模拟之分  详情 回复 发表于 2018-11-2 13:47

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    8#
    发表于 2018-11-2 13:47 | 只看该作者
    kevin890505 发表于 2018-11-2 09:45
    ' f& L" E  M' \# T( W这肯定了撒,最低成本的方案。还是要出现非稳态。    这两个并不矛盾,你不关心这个非稳态自然无所谓,因 ...

    6 i* e2 e$ ^# T1 z6 o: u  Y是的,非常同意上面版主说的,非常到位,本没有数字模拟之分
    ! x! W7 U$ ?9 f3 V2 ?* {5 Y+ i

    该用户从未签到

    9#
    发表于 2018-11-2 15:58 | 只看该作者
    你用的滤波电容也是太大了,去掉吧,什么东西会有这么大需要滤波的哦。

    该用户从未签到

    10#
    发表于 2018-11-7 13:42 | 只看该作者
    滤波参数太奇葩
  • TA的每日心情
    无聊
    2023-9-5 15:54
  • 签到天数: 1 天

    [LV.1]初来乍到

    11#
     楼主| 发表于 2018-11-8 08:31 | 只看该作者
    谢谢各位; RC这里不是滤波,是想delay, 满足时序要求; 其实是我忽略了 与门对输入端上升沿的参数要求;
  • TA的每日心情
    擦汗
    2021-7-2 15:02
  • 签到天数: 6 天

    [LV.2]偶尔看看I

    13#
    发表于 2018-11-12 21:21 | 只看该作者
    看电路图是PC同行,这里不一定用与门,用1个3pin 的二极管 做与门,保证SLP_S3和PG_3.3V 都是高时才打开,
    : p6 c, L6 V) l! @' T! R" B如果调timing的话,在VCCIO power IC enable段加RC 去调,这样更方便。, _5 W& @5 p5 u! \$ K4 q
    我司最普遍电路图都是这么处理的。  ]- B% K4 ?: X! H3 d/ |
    请忽略我是一个灵魂画手

    无标题.png (20.87 KB, 下载次数: 6)

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