第9章 DDRx仿真 ---问题与答疑

amao · 发表于 2018-1-12 08:42

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第9章 DDRx仿真 ---问题与答疑

lature · 发表于 2018-2-8 23:29

本帖最后由 lature 于 2018-2-8 23:31 编辑

DDR 仿真中失败，是什么原因？如图

lpc_2138 · 发表于 2018-2-8 20:51

大家好，请教一个问题，我在进行ddr仿真的时候，操作到书中P241，“3.添加模型”，执行完【Auto Pin Mapping】，点击【ok】按钮之后出现提示框”NO POWER PIN CONNECTTED . SELECT ONE POWER PIN AT LEAST“。不太清楚哪个环节出了问题，应该在哪里添加power pin。

mingzhesong · 发表于 2018-1-31 16:47

第245页，图9-63，按照文字说明，仿真选择地址控制组信号和一组数据信号分析，图9-63实际勾选的是地址信号和时钟信号。

大风起_云飞扬 · 发表于 2018-1-22 16:11

本章DDR仿真，用的是speed2000，拿到了对应的案例spd了，controller和对应颗粒的IBIS模型能不能提供呢。再就是speed2000仿真，怎么考虑PKG的影响？

GHOST · 发表于 2018-1-24 13:39

模型上也可以加封装信息的吧，R L C设置进去？

阡陌 · 发表于 2018-1-24 16:40

你好，请问在SYSTEM SI中加载PKG时，供应提供的S参数部分如截图，一个PIN对用两个DIE,在互联是应该如何操作？直接一个PIN连接两个DIE吗？谢谢。

GHOST · 发表于 2018-1-24 18:08

是这样子吧？？

阡陌 · 发表于 2018-1-24 18:45

GHOST 发表于 2018-1-24 18:08
是这样子吧？？

是一颗MEM有两个DIE,两个DIE还有一部分信号是共用的，所以分成两个不太合适吧，所以这里不清楚怎么操作。

GHOST · 发表于 2018-1-25 10:14

阡陌发表于 2018-1-24 18:45
是一颗MEM有两个DIE,两个DIE还有一部分信号是共用的，所以分成两个不太合适吧，所以这里不清楚怎么操作。 ...

共用的也有PORT的吧？像上面图中的DQS0，是否可以这样子理解：一个MEM里面集成了2颗DDR颗粒？

icy88 · 发表于 2018-1-25 16:30

5楼正解

superlish · 发表于 2018-1-31 17:38

mingzhesong 发表于 2018-1-31 16:47
第245页，图9-63，按照文字说明，仿真选择地址控制组信号和一组数据信号分析，图9-63实际勾选的是地址信号 ...

看的好仔细啊

阡陌 · 发表于 2018-2-7 12:35

1、使用SYSTEM SI进行仿真时，这个参数如何设置，有什么参考依据？
2、目前仿真的是LPDDR3的眼图，仿真出来裕量很大，和供应商提供测试报告差距很大，不清楚是什么环节的问题，有没有用SYSTEM SI仿真DDR的，可以一起交流一下。

superlish · 发表于 2018-2-8 15:03

阡陌发表于 2018-2-7 12:35
1、使用SYSTEM SI进行仿真时，这个参数如何设置，有什么参考依据？
2、目前仿真的是LPDDR3的眼图，仿真出 ...

1\时序可以看数据手册要求
2\仿真和实测不一样很难说是什么原因的吧，得看具体环境和条件，例如有些板DDR我们看到加的测试点是在线上的，具体位置是不确定的，实测时候有可能收发都是点的同一个点？？或者把过孔刮开靠近芯片测试的，但是有些信号是表层拉出来很长一段打孔的，这时候这个孔是在中间的，都有可能

superlish · 发表于 2018-2-9 09:51

lpc_2138 发表于 2018-2-8 20:51
大家好，请教一个问题，我在进行ddr仿真的时候，操作到书中P241，“3.添加模型”，执行完【Auto Pin Mappi ...

这个会自动识别的，看看会不会是电源设置有问题？

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