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[HyperLynx] DDR仿真网络选择

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发表于 2018-1-11 17:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用DDR仿真的时候,选择数据网络的时候为何DQ/DM分一起,见图中箭头处。是哪里出错了,如何改正?求教3 i4 D/ _' M; i: N

2018-01-11_17-24-33.jpg (189.53 KB, 下载次数: 3)

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发表于 2018-1-13 10:32 | 只看该作者
前面网络那一步没有问题吗?
- m' Y/ t, Z( H. j1 k 5 y6 R6 L4 D" c4 r( t! J

点评

没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。  详情 回复 发表于 2018-1-15 10:26

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3#
发表于 2018-1-13 14:58 | 只看该作者
参考差分的形式,你的模型是不是有问题?定义了差分?

点评

有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?  详情 回复 发表于 2018-1-15 10:29

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4#
 楼主| 发表于 2018-1-15 10:26 | 只看该作者
superlish 发表于 2018-1-13 10:326 q/ ^9 H2 Q, A0 {
前面网络那一步没有问题吗?

! z% O0 i, G' U" s8 t9 \没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。9 w3 F! ]6 c5 n+ @) A- o6 w

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5#
 楼主| 发表于 2018-1-15 10:29 | 只看该作者
GHOST 发表于 2018-1-13 14:58. u; M# X- _9 |$ U* ]7 C
参考差分的形式,你的模型是不是有问题?定义了差分?

. R* U& w8 E) ~0 ?' N有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?
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点评

直接打开就可以看啊  详情 回复 发表于 2018-1-15 11:53

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发表于 2018-1-15 11:53 | 只看该作者
dhgchina 发表于 2018-1-15 10:29
' u* _4 H$ i$ K& r4 i有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变 ...
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直接打开就可以看啊
" J1 |& X7 y1 A. I0 _. i% V/ E- {0 C

点评

问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了  详情 回复 发表于 2018-1-15 20:27
打开看没问题啊,有什么解决办法没有?  详情 回复 发表于 2018-1-15 17:13

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 楼主| 发表于 2018-1-15 17:13 | 只看该作者
GHOST 发表于 2018-1-15 11:53( b! z' g$ Z+ x& Q$ f1 _
直接打开就可以看啊
- q* T" m% f, K+ s; r; J5 |
打开看没问题啊,有什么解决办法没有?# ?! f' ~# L4 t; k/ W- {  ^

2018-01-15_17-10-47.jpg (321.1 KB, 下载次数: 3)

2018-01-15_17-10-47.jpg

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8#
 楼主| 发表于 2018-1-15 20:27 | 只看该作者
GHOST 发表于 2018-1-15 11:53
" t/ J+ [/ i! y7 P6 S: n/ f直接打开就可以看啊

* I! J% P2 O9 ~$ o问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了6 t5 v! Q+ l: m5 C# v2 [
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