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[HyperLynx] DDR仿真网络选择

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发表于 2018-1-11 17:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用DDR仿真的时候,选择数据网络的时候为何DQ/DM分一起,见图中箭头处。是哪里出错了,如何改正?求教3 Y% r, {$ ~# K

2018-01-11_17-24-33.jpg (189.53 KB, 下载次数: 2)

2018-01-11_17-24-33.jpg

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2#
发表于 2018-1-13 10:32 | 只看该作者
前面网络那一步没有问题吗?
$ `- V* P; c+ w% W0 s 8 F& A; N( {) M1 \! t

点评

没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。  详情 回复 发表于 2018-1-15 10:26

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3#
发表于 2018-1-13 14:58 | 只看该作者
参考差分的形式,你的模型是不是有问题?定义了差分?

点评

有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?  详情 回复 发表于 2018-1-15 10:29

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4#
 楼主| 发表于 2018-1-15 10:26 | 只看该作者
superlish 发表于 2018-1-13 10:32
& t# G( j# n! t前面网络那一步没有问题吗?

) R0 G8 r7 }! Y8 ]/ u/ g0 }/ F没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。* y& r9 i; ]  A" B

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5#
 楼主| 发表于 2018-1-15 10:29 | 只看该作者
GHOST 发表于 2018-1-13 14:58
! C5 j  G: t- B2 H$ E( m# k  f参考差分的形式,你的模型是不是有问题?定义了差分?

" M: y' }" {! Z/ h& j有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?
. C/ \1 G9 w: |3 }5 E/ D

点评

直接打开就可以看啊  详情 回复 发表于 2018-1-15 11:53

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6#
发表于 2018-1-15 11:53 | 只看该作者
dhgchina 发表于 2018-1-15 10:295 q+ R* h6 k3 D, C& G+ Z
有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变 ...
$ y. s' A& B& `+ G, n
直接打开就可以看啊3 |- g7 A3 d1 J

点评

问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了  详情 回复 发表于 2018-1-15 20:27
打开看没问题啊,有什么解决办法没有?  详情 回复 发表于 2018-1-15 17:13

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 楼主| 发表于 2018-1-15 17:13 | 只看该作者
GHOST 发表于 2018-1-15 11:53$ y% L, U4 q* B, N( s+ R% m# H
直接打开就可以看啊

! Q# u# L; `$ S: D9 l- f打开看没问题啊,有什么解决办法没有?
! |9 w* a" c* v. v  V* ?

2018-01-15_17-10-47.jpg (321.1 KB, 下载次数: 1)

2018-01-15_17-10-47.jpg

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8#
 楼主| 发表于 2018-1-15 20:27 | 只看该作者
GHOST 发表于 2018-1-15 11:53
. C" f# f1 \$ ^直接打开就可以看啊
8 G3 K" ^; }) w: j$ Q2 o7 G
问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了! [4 X5 S" a% {
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