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2017年12月29日QA检查报告节选

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发表于 2017-12-30 08:53 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.电源太细5 v( e' K# Y+ v. |0 I% B# S
" O, S' l9 C6 R0 D$ p/ x( H( r
[url=https://www.eda365.com/thread-160823-1-1.html][/url]
3 r$ S% h, D3 W& L+ e

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发表于 2018-1-2 20:11 | 只看该作者
EDA365QA 发表于 2017-12-30 08:536 e( o; F4 {" Q. V$ X& x
4.多个千兆网口线建议有参考面
6 Q' z+ E/ P- h6 Q
为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。
, a+ O( y$ l; @. l( s1 }

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发表于 2018-1-2 09:29 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53
7 p* N* K# J8 J) I# p3 S4.多个千兆网口线建议有参考面
/ C/ p5 }1 N  G
请教一下,这个参考面是需要用外壳地来做吗?; Z0 C! F. u# X4 O: w: F

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推荐
发表于 2018-1-2 13:30 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53' ]: K: S# e+ t6 O- V4 b) S; ^! Z2 f
4.多个千兆网口线建议有参考面
5 P- }, [3 y: h  J) c/ f! f
建议用中心抽头上的地,不能用机壳地!
( |- Q" |; Y4 Z% U5 L1 S# G

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2#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
2.电感加强2 ]8 t  W9 f  i3 g: Z( {. {
# z1 q* ~" ?, O0 F/ @. s

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3#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
3.电阻两端需等长
8 i3 R! [6 \( q1 [ 4 M  |* s+ D3 J- f" ?

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4#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
4.多个千兆网口线建议有参考面
0 i6 r$ c( [" D. E( G7 ]0 F1 c/ X 5 E6 S/ }' P. }- r4 }, N, k6 p$ L

点评

为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。  详情 回复 发表于 2018-1-2 20:11
建议用中心抽头上的地,不能用机壳地!  详情 回复 发表于 2018-1-2 13:30
请教一下,这个参考面是需要用外壳地来做吗?  详情 回复 发表于 2018-1-2 09:29

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5#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
5.USB参考平面要完整
. X5 j% N$ z- r& X( ~ 5 ~3 X. l/ U, t3 W6 B

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6#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
6.电源有瓶颈$ @4 u6 Y) i$ n4 t, d+ n" @' t5 E

- K$ H" g8 {9 E/ D

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7#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
7.有部分模拟线没加粗
, X% V9 H) ]& N4 i; q6 r+ C
* ?/ X  }& ?# e) [1 E- M

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8#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
8.电源加粗
8 g- F& S) f1 C* [
1 c$ J% _' x. R: I

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9#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
9.CAN走差分
/ J. y* J9 g4 w' u 8 Q; q4 ~; _& z! l# ]& f" |

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10#
 楼主| 发表于 2017-12-30 08:55 | 只看该作者
10.电源输入在电容前打VIA,输出电源加粗.
# [0 ^6 D# C& l; i8 c! J) O; ?
3 A0 o+ P. ?3 {" e5 ]* b' J
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