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2017年12月29日QA检查报告节选

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1#
发表于 2017-12-30 08:53 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.电源太细
2 g, m  L/ N. L# Z4 v9 _   y- R2 F- @( E7 N" o
[url=https://www.eda365.com/thread-160823-1-1.html][/url]
/ \# g( s& H7 x( [3 r

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发表于 2018-1-2 20:11 | 只看该作者
EDA365QA 发表于 2017-12-30 08:530 E" P( Q( L. p# o$ X1 b2 [
4.多个千兆网口线建议有参考面
+ t' c0 H1 a9 q; p
为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。
  w9 a8 W7 `2 k# W6 G9 _

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发表于 2018-1-2 09:29 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53- F* }* }' M. U% @
4.多个千兆网口线建议有参考面
. r+ K3 _. r) W' ^
请教一下,这个参考面是需要用外壳地来做吗?
  c& j' `5 K- K$ B! ]9 e

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推荐
发表于 2018-1-2 13:30 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53
/ u* v1 i& X  m; @7 [4.多个千兆网口线建议有参考面
, w. ~+ V) K0 I
建议用中心抽头上的地,不能用机壳地!
  G. I* ^0 X, ]$ A  E4 v

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2#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
2.电感加强, e- ^) t+ y) e4 g* q0 u0 j9 ?1 Y2 i; J9 [

% `6 ~2 u# Q+ g, j5 G

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3#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
3.电阻两端需等长
8 T% W' a% _6 R1 A: q * X6 p& Q) n( d( S" }9 j

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4#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
4.多个千兆网口线建议有参考面
% I5 F2 v: M+ s0 A3 D $ ?* U& k: O5 C* Q2 |

点评

为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。  详情 回复 发表于 2018-1-2 20:11
建议用中心抽头上的地,不能用机壳地!  详情 回复 发表于 2018-1-2 13:30
请教一下,这个参考面是需要用外壳地来做吗?  详情 回复 发表于 2018-1-2 09:29

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5#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
5.USB参考平面要完整& }  M8 e/ F- P; q7 N1 l; b0 s

: k! e9 k3 R+ q$ ?2 R0 ]

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6#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
6.电源有瓶颈2 R% |6 h$ P6 d# |4 G0 s* T
" N/ O0 W1 T  o

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7#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
7.有部分模拟线没加粗
  [9 H* p. ]6 Q 5 Y$ k$ }! P, P0 Y; q, a7 `6 T

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8#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
8.电源加粗
, @1 \3 Y# a- d& h/ d: E
  A: p* P  s3 {1 `0 h3 |

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9#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
9.CAN走差分
- S$ J6 X% @6 O( m2 h! r
8 w( K# a, e0 B  A- d3 b+ h8 y

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10#
 楼主| 发表于 2017-12-30 08:55 | 只看该作者
10.电源输入在电容前打VIA,输出电源加粗.- D7 D. ^) |+ H: t

& |' E5 S+ j* H; b# H( F
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