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2017年12月7日QA检查报告节选

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1#
发表于 2017-12-8 09:16 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.电源PIN加粗5 s& Z% D, l) B+ u. g4 c' a; D# Q- n

* h( |; V4 L) G

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 楼主| 发表于 2017-12-8 09:17 | 只看该作者
4.REF加粗2 Y+ V( Z! G2 D4 G) E
3 \+ ~" [$ N' w& S# c9 Z

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推荐
发表于 2017-12-21 10:39 | 只看该作者
gaolujie8080 发表于 2017-12-21 10:26% l" N. J% [( W+ H9 Z& P3 q: u
作为一个allegro新手,我想问下,这个花焊盘不是自动生成的吗?如何修改引脚的粗细

% K% ?; S3 v/ a$ ^6 g0 P可以更改设置。或者全连接挖一下。

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推荐
发表于 2017-12-21 10:26 | 只看该作者
EDA365QA 发表于 2017-12-8 09:16
- F4 c5 X1 f; _$ Y) j; @2.电源热焊盘加粗
& Z5 [, W) p$ ~  `/ h% B+ R5 R
作为一个allegro新手,我想问下,这个花焊盘不是自动生成的吗?如何修改引脚的粗细
( F! l; X! w" |, X& H

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2#
 楼主| 发表于 2017-12-8 09:16 | 只看该作者
2.电源热焊盘加粗
( I9 S/ v& I) ]4 {# L: b$ @* f * j  T8 H2 Z+ [! `- i

点评

作为一个allegro新手,我想问下,这个花焊盘不是自动生成的吗?如何修改引脚的粗细  详情 回复 发表于 2017-12-21 10:26

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3#
 楼主| 发表于 2017-12-8 09:16 | 只看该作者
3.SENSE要在负载端走类差分+ E( c0 n) u* Z8 J, I3 g

8 ~3 `2 V5 p, G1 Q+ M
  v& A' z4 _  i" v7 D4 G5 C8 {/ T' M * k4 n3 c* {+ V/ h' k

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5#
 楼主| 发表于 2017-12-8 09:17 | 只看该作者
5.防焊层有丝印7 Q- l4 w9 S& ^

7 X2 Q# G7 F: ]5 m+ t/ x3 s  j; ~9 [

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6#
 楼主| 发表于 2017-12-8 09:17 | 只看该作者
6.QDR的地址与写数据一起等长1 w" q( N. Y8 C6 Z4 D7 k" ^
8 C5 v$ ?$ Y( E2 ~* {; E

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7#
 楼主| 发表于 2017-12-8 09:18 | 只看该作者
7.Rf信号表层包上地
- z0 z: V. y+ o; r
7 a$ ~- l# p) i9 o! ]

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8#
 楼主| 发表于 2017-12-8 09:18 | 只看该作者
8.强连的孔没有焊盘
/ I+ A9 Y4 t* s0 M: y
# ]+ H. Y' `' c* d  `- `) T1 g

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9#
 楼主| 发表于 2017-12-8 09:18 | 只看该作者
9.电源过细
6 i1 b' I. x( B+ J; E ( r% E% \/ U6 Y; N5 s- Q

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10#
 楼主| 发表于 2017-12-8 09:18 | 只看该作者
10.有线在分割上! q9 A$ G. j" F9 B

5 `  d" V' G: G1 R8 M6 N

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11#
 楼主| 发表于 2017-12-8 09:19 | 只看该作者
11.走线尽量先过ESD8 _- K& O  |# r! Q
+ L! k% t2 l7 t' R0 S+ ?$ a

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13#
发表于 2017-12-8 09:42 | 只看该作者
太棒了,已经发了项目,请版主大大帮忙检查。谢谢!
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