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楼主: EDA365QA
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2017年11月23日QA检查报告节选

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该用户从未签到

16#
发表于 2017-11-27 09:53 | 只看该作者
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?

点评

光耦最好能够所有层挖空,完全隔离。  详情 回复 发表于 2017-11-28 09:22

该用户从未签到

18#
 楼主| 发表于 2017-11-28 09:22 | 只看该作者
dhhtmqh 发表于 2017-11-27 09:53
) @2 W9 W2 y' b这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?

- ?! x1 N3 @7 x4 [; N( [光耦最好能够所有层挖空,完全隔离。$ b# ?. Z# e. m6 m3 R
  • TA的每日心情
    开心
    2022-12-16 15:46
  • 签到天数: 2 天

    [LV.1]初来乍到

    19#
    发表于 2017-11-28 16:34 | 只看该作者
    EDA365QA 发表于 2017-11-24 09:02
    7 x( z4 I, b* I6.RGB没等长
      p6 ?7 R" `1 F0 ^* S" h# @7 p
    RGB是灯的那个么,有要求等长么?
    : _( S' I! y  q. F5 p* U
    ; y" v! w+ u( s6 N- V2 N/ ^# k

    该用户从未签到

    20#
     楼主| 发表于 2017-11-29 09:40 | 只看该作者
    橡皮擦先生 发表于 2017-11-28 16:34
    % \+ Y; M0 ?3 |7 c) ]3 L8 @0 MRGB是灯的那个么,有要求等长么?
    6 Y+ c' f1 Z0 P0 W' _5 I$ h
    不是灯信号,0-7位数据线最好等长。. ?6 w. K) [1 c6 [( s
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