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楼主: EDA365QA
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2017年11月23日QA检查报告节选

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该用户从未签到

16#
发表于 2017-11-27 09:53 | 只看该作者
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?

点评

光耦最好能够所有层挖空,完全隔离。  详情 回复 发表于 2017-11-28 09:22

该用户从未签到

18#
 楼主| 发表于 2017-11-28 09:22 | 只看该作者
dhhtmqh 发表于 2017-11-27 09:533 W0 y  C2 _* a# |* N
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?
( z* D, T, X5 X$ }' m% I
光耦最好能够所有层挖空,完全隔离。
" L2 H: s/ T* W, ]$ d# i* k/ i
  • TA的每日心情
    开心
    2022-12-16 15:46
  • 签到天数: 2 天

    [LV.1]初来乍到

    19#
    发表于 2017-11-28 16:34 | 只看该作者
    EDA365QA 发表于 2017-11-24 09:02
    9 N1 c$ D, M! P6 Q' R) N) t6.RGB没等长

    " I3 b" D5 D; G% d2 bRGB是灯的那个么,有要求等长么?
    8 D7 \4 m0 D0 {6 U: U: a6 T3 g

    点评

    不是灯信号,0-7位数据线最好等长。  详情 回复 发表于 2017-11-29 09:40

    该用户从未签到

    20#
     楼主| 发表于 2017-11-29 09:40 | 只看该作者
    橡皮擦先生 发表于 2017-11-28 16:34
    / W/ x. o0 O. G5 N  ORGB是灯的那个么,有要求等长么?

    2 g5 w& [8 J; h2 ]不是灯信号,0-7位数据线最好等长。5 w1 t1 o* \! D, d3 Q
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