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楼主: EDA365QA
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2017年11月23日QA检查报告节选

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该用户从未签到

16#
发表于 2017-11-27 09:53 | 只看该作者
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?

点评

光耦最好能够所有层挖空,完全隔离。  详情 回复 发表于 2017-11-28 09:22

该用户从未签到

18#
 楼主| 发表于 2017-11-28 09:22 | 只看该作者
dhhtmqh 发表于 2017-11-27 09:53' {2 ?, R' [; C- ?0 m
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?

+ @' f0 W' ]( g+ a光耦最好能够所有层挖空,完全隔离。5 u9 B7 Q. I( C' Y1 Y
  • TA的每日心情
    开心
    2022-12-16 15:46
  • 签到天数: 2 天

    [LV.1]初来乍到

    19#
    发表于 2017-11-28 16:34 | 只看该作者
    EDA365QA 发表于 2017-11-24 09:02+ x! c) J; C) w% y  Z
    6.RGB没等长

    ! w( W5 H- ]6 i( K& ZRGB是灯的那个么,有要求等长么?
    3 E" ~+ t. {% o2 k# ~6 \
    1 y6 M) G& _- N+ |: C5 w; ~! h  \

    该用户从未签到

    20#
     楼主| 发表于 2017-11-29 09:40 | 只看该作者
    橡皮擦先生 发表于 2017-11-28 16:34
    ! |3 [8 f" f5 |  A, G* T5 E% C! gRGB是灯的那个么,有要求等长么?
    % q2 A" G7 u% K3 B5 V: H
    不是灯信号,0-7位数据线最好等长。
    4 x5 V0 s! @8 F/ B, e8 D
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