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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › EDA365作品展 › 华为海思HI3559V100官方demo
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华为海思HI3559V100官方demo

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Haiting32451

该用户从未签到
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1#
发表于 2017-11-8 15:00 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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Linxf

该用户从未签到
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发表于 2018-12-3 19:30 | 只看该作者
咨询下楼主' g3 B$ A1 y7 B2 d* l0 Q
1、海思开发板一般都是要求DDR部分不要作改动，预览前面的网页也有同学提到他们公司改动了几根后面出问题，可是问题是海思开发板的叠层参数给的都不是很完整，叠层结构以及各层的厚度有给出，但是介电常数都是4.5（从工程文件的Cross-section中查看），按这个参数结合线宽线距以及对阻抗的要求，制板厂家根本设计不出叠层参数，请问楼主有了解吗( d/ x% J& x( X/ V0 U

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Frankie1
  • TA的每日心情
    开心
    2024-10-12 15:29

    • 签到天数: 8 天

    [LV.3]偶尔看看II
    推荐
    发表于 2023-8-4 22:26 | 只看该作者
    kkk                                                                  

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    haoyingxiang

    该用户从未签到
    5#
    发表于 2017-11-8 20:35 | 只看该作者
    有原理图么

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    dqwuf2008

    该用户从未签到
    8#
    发表于 2017-11-9 10:07 | 只看该作者
    求原理图一份
    4 Q3 U. P* R( N3 X

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    qiujin
  • TA的每日心情
    无聊
    2021-1-12 15:54

    • 签到天数: 1 天

    [LV.1]初来乍到
    9#
    发表于 2017-11-10 16:40 | 只看该作者
    很想观摩一下，谢谢！

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    tiankong2008

    该用户从未签到
    10#
    发表于 2017-11-12 12:17 | 只看该作者
    的点点滴滴多多
    ) b6 }! y, v. L: l: x

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    llyygg
  • TA的每日心情
    开心
    2025-6-11 15:31

    • 签到天数: 549 天

    [LV.9]以坛为家II
    16#
    发表于 2017-11-15 10:38 | 只看该作者
    很想观摩一下，谢谢！

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