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2017年10月20日QA检查报告节选

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发表于 2017-10-24 11:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-10-24 11:34 编辑
1 a# N  q' N8 ]1 s# q5 D
/ V7 a2 P* z/ w. R$ c3 Y$ s0 _- B  O/ Z1.电源没加粗
. w( J" I0 G, U1 r- r; J
; s" G4 t3 \5 A$ ]* a4 Q$ Q; `. n

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2#
 楼主| 发表于 2017-10-24 11:32 | 只看该作者
2.钢网层有多余的线: a: \6 e  U9 x' @6 o, a  c! S2 _  A

) k, g# s* [9 o& P7 t  K5 r1 D

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3#
 楼主| 发表于 2017-10-24 11:35 | 只看该作者
3.周边螺孔与器件干涉
7 j/ Y7 d/ b7 ~ % F5 f7 R- W' \  p! ^7 m

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4#
 楼主| 发表于 2017-10-24 11:36 | 只看该作者
4.变压器前后隔离& T  x% ^' @( i8 i
8 ]* T# _1 I' Y3 V6 M

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5#
 楼主| 发表于 2017-10-24 11:38 | 只看该作者
5.电源VIA只有1个,另有三个没网络过孔VIA。/ d1 Y- c+ j+ I8 c2 Q8 q. \7 a
1 y! ~: S; V5 t' E( s  C

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6#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
6.DVI线对间等长
4 {  O+ ^  w7 D) v7 G & g7 c5 k) D, q+ t# i$ B; t

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7#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
7.电源没加粗6 s5 N( e9 I" ^: Q5 J

8 Q2 p5 T7 Q: I# a; C( ~

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8#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
8.flash拓扑不一致7 @4 l- D: k8 e, B
  q6 ^( O) G" d9 ~+ ?/ c3 a

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9#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
9.变压器中间挖空不过线前后隔离
9 C" [! F3 c0 A1 h8 G; X 4 s( {0 ~" ^$ I  R6 o

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10#
 楼主| 发表于 2017-10-24 11:46 | 只看该作者
10.共LAYOUT不要出现残端
' r" r" X: x5 ~, ^; L
* r" }8 E5 H. [; s6 n/ M" @1 ?

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15#
发表于 2017-10-26 16:49 | 只看该作者
EDA365QA 发表于 2017-10-24 11:45" x2 D) ~. Z! U
8.flash拓扑不一致
6 g- d: g8 m  d
2 Q. n/ i( B$ D; z
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