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2017年10月20日QA检查报告节选

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1#
发表于 2017-10-24 11:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-10-24 11:34 编辑
0 T( n' A0 z. a+ w& S  |* W- V0 V* o7 i
1.电源没加粗& `8 N4 i0 [& ~& o8 k  P" J! w

8 R! ~+ q8 k; D8 Q" k4 T  r

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2#
 楼主| 发表于 2017-10-24 11:32 | 只看该作者
2.钢网层有多余的线. `  ^8 z; {* o$ I6 _: i  y

" f% A* M# K' K

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3#
 楼主| 发表于 2017-10-24 11:35 | 只看该作者
3.周边螺孔与器件干涉8 n' p) ~* g# |8 F; w( o
* a9 P9 x& w, X. X/ V9 S

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4#
 楼主| 发表于 2017-10-24 11:36 | 只看该作者
4.变压器前后隔离! R, `# e) L0 E# P
, S4 v' T% g0 W8 n9 w. \( W

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5#
 楼主| 发表于 2017-10-24 11:38 | 只看该作者
5.电源VIA只有1个,另有三个没网络过孔VIA。' l; W% q8 p/ q- `
. R: w1 Z; c: G2 Q

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6#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
6.DVI线对间等长; v# s: W# s/ @7 Q/ y

% C1 b5 I- \! I+ z& M

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7#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
7.电源没加粗$ ^+ X; u: m* {7 B! ?7 H

- g8 ^' a2 O% B, j9 |

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8#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
8.flash拓扑不一致' H" t4 S& l: l1 P* j) i  n

/ c5 T" ]+ |6 K2 l& A; I, E

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9#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
9.变压器中间挖空不过线前后隔离
# r) }% g4 V" D* s* z$ S % x7 j1 Q, l2 k7 E; i  g) P

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10#
 楼主| 发表于 2017-10-24 11:46 | 只看该作者
10.共LAYOUT不要出现残端4 |: g5 L5 S) n

; b. L2 B, J$ j

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15#
发表于 2017-10-26 16:49 | 只看该作者
EDA365QA 发表于 2017-10-24 11:45
9 t  q) `) }. k, {7 ?8 h8.flash拓扑不一致
9 ?$ g( ]! u$ l
  ?* m+ }7 r/ Y1 [
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