2017年6月30日公益PCB评审报告节选

七彩雨 · 发表于 2017-7-5 16:45

EDA365QA 发表于 2017-7-1 11:59
& l' Y- ^0 i7 S, i" G' s6. 高速线走在隔离盘下了.

右边6对差分，难以避免吧，用什么方式可以改善呢？

Jasminetr · 发表于 2017-7-6 20:19

有些还真不懂啊

pcb · 发表于 2017-7-10 09:25

EDA365QA 发表于 2017-7-1 11:59
% b+ s8 a2 ~: ~6. 高速线走在隔离盘下了.

差分线调整到两排PIN中间是可以避免的.

小千 · 发表于 2017-7-13 17:23

EDA365QA 发表于 2017-7-1 12:00
0 K" M/ c! C* L S" e1 U' F* j7. 高压部分的电阻下也要挖空处理.

为什么需要挖空处理？

小千 · 发表于 2017-7-13 17:25

EDA365QA 发表于 2017-7-1 12:04
& @+ K6 K8 @( K* s8 ^8 q1 t10. 屏蔽罩全开钢网了,建议分段开.

全开钢网与分断开钢网有什么区别？

陆大少 · 发表于 2017-10-9 11:07

EDA365QA 发表于 2017-7-1 12:04
8 i8 T# ?" b: v" B1 p% b10. 屏蔽罩全开钢网了,建议分段开.

LiuTao166462139 · 发表于 2017-11-4 16:44

学习了一下

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