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ddr2跑不起来跟什么有关呢?

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发表于 2017-5-25 13:44 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近画了一个板子,改了两板都跑不起来,数据线比时钟长了1000MIL,不知道跟这个有没有关系,还是跟网络变压器有关,DDR2下面有个网络变压器,下面挖空的![img]file:///C:\Users\cdt\AppData\Roaming\Tencent\Users\273291066\QQ\WinTemp\RichOle\@THF~([N@4J]WMY}%)IY(2I.png[/img]
) S: r1 n# L% `4 T! s6 Q0 e9 J, Y* g% V' _9 R4 o

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 楼主| 发表于 2017-5-25 16:05 | 只看该作者
小秋2013 发表于 2017-5-25 15:51" n8 h- X9 ~* Q
网络变压器不能移出DDR走线区域吗,我觉着这个有问题,一般DDR走线不要跨区域,还有一般是时钟线长吧,或者 ...
0 O0 z4 L4 y9 v- Q% w
这个网络变压器移不走了,板子太拥挤了才这样了,其它板子能跑起来!这个是没办法的,问过硬件工程师,他那个网络变压器在下面是没问题的,他现在也没叫我改,我只想知道为什么跑不起来而已!时钟线要比数据线长吗?就是那个CLK时钟线7 v) ^  M- Q( D4 |4 T! e
# k4 z# M+ }. M+ b* ~* O

点评

理论上是时钟线最长,你最好看看芯片资料,里面应该有这方面的要求的。  详情 回复 发表于 2017-5-25 17:00

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 楼主| 发表于 2017-5-31 15:37 | 只看该作者
ALLEGROPCB 发表于 2017-5-27 10:193 L! e; \' T* Y2 c+ ~
你这个跑步起来很正常,一般时钟最长, 具体看芯片指南,有一些芯片,是数据线和时钟误差不能超过600. 。。 ...

6 }4 n$ D, _1 R) B5 E; x你好,不好意思,文件公司不让上传的!另外画的一个板子,数据也比时钟长,大概是在500MIL内,能跑起来,这个跑不起来的板子,结构有限制,板子太小,CLK时钟无法走比数据线长,现在怀疑是信号完整性问题,重新改板,到时看看能不能跑起来
3 K$ }! R( L* u

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 楼主| 发表于 2017-5-31 15:30 | 只看该作者
superlish 发表于 2017-5-26 18:28( _9 o0 C% v& @7 n- m
这三根是否是需要等长的?你这里差的好大啊  (有PIN延时吗?? DDR2就用单端1根DQS,有要求全等长的,不知 ...

0 g9 p3 J+ A4 B! e/ ]2 _) w/ u没有等长,你指的三条信号线是MDQS0,MDATA7和MDATA5.MDATA7和MDATA5是等长的, o( ~6 A. {  N, W

' O. r4 G' j' m" U+ y. h5 s' C

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3#
发表于 2017-5-25 14:04 | 只看该作者
你真行,首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。

点评

布局有什么问题呢,可以说说么  详情 回复 发表于 2017-5-25 15:31
数据线有做等长呀,地址,时钟,命令也做了等长了呀  详情 回复 发表于 2017-5-25 15:30

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4#
发表于 2017-5-25 14:19 | 只看该作者
yangjinxing521 发表于 2017-5-25 13:49
0 d3 O) A/ `2 @! n7 ]人品。。。。

0 t# f) o" w) y6 d; g+ k% ~+ A看看我的帖子DDR怎么跑不起来呢6 y- u$ y0 d% ^$ i) j; z% d

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5#
 楼主| 发表于 2017-5-25 15:30 | 只看该作者
丁少_bmPRb 发表于 2017-5-25 14:044 d8 O* s( a0 i& F+ z( ]" S! {$ ^
你真行,首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。
, ]# {: x# d- p' l  y9 g/ ?- w
数据线有做等长呀,地址,时钟,命令也做了等长了呀# C* I0 v- K/ ]

6 H3 A2 g0 n. n) p

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6#
 楼主| 发表于 2017-5-25 15:31 | 只看该作者
丁少_bmPRb 发表于 2017-5-25 14:043 {  @4 H3 _: l* m' e8 N' q; |, j+ ?+ w
你真行,首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。
9 M) X+ n/ s2 T. R9 S+ J. y4 C
布局有什么问题呢,可以说说么8 \6 i$ F- V2 X5 `7 i3 y

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7#
发表于 2017-5-25 15:51 | 只看该作者
网络变压器不能移出DDR走线区域吗,我觉着这个有问题,一般DDR走线不要跨区域,还有一般是时钟线长吧,或者看看spc里面的具体要求

点评

这个网络变压器移不走了,板子太拥挤了才这样了,其它板子能跑起来!这个是没办法的,问过硬件工程师,他那个网络变压器在下面是没问题的,他现在也没叫我改,我只想知道为什么跑不起来而已!时钟线要比数据线长吗?  详情 回复 发表于 2017-5-25 16:05

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9#
发表于 2017-5-25 17:00 | 只看该作者
Trista 发表于 2017-5-25 16:05$ Q# V8 c; p( W3 F2 _
这个网络变压器移不走了,板子太拥挤了才这样了,其它板子能跑起来!这个是没办法的,问过硬件工程师,他 ...

2 `4 U: y% g: e2 C理论上是时钟线最长,你最好看看芯片资料,里面应该有这方面的要求的。

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好的  详情 回复 发表于 2017-5-25 17:50

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10#
 楼主| 发表于 2017-5-25 17:50 | 只看该作者
小秋2013 发表于 2017-5-25 17:00
) q2 _% ?, x0 Z9 ~理论上是时钟线最长,你最好看看芯片资料,里面应该有这方面的要求的。

! _0 O1 M- W1 |5 ?. [好的
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    11#
    发表于 2017-5-26 01:02 | 只看该作者
    信号质量严重不好,

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    12#
    发表于 2017-5-26 10:45 | 只看该作者
    能不能把整个板子贴出来看下?
    + v: W& @" s. ?+ z& s5 o网络变压器下面挖空了那你这块怎么控制阻抗呢?
    + Z: M5 E7 [8 l! [, E6 X# _(貌似你底下走了这么多线不叫挖空了吧?挖空不了)

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    13#
     楼主| 发表于 2017-5-26 11:16 | 只看该作者
    superlish 发表于 2017-5-26 10:45' X4 P5 f  j/ {3 f
    能不能把整个板子贴出来看下?) o5 u2 K$ a$ e$ S/ b7 A! I  z2 E$ s
    网络变压器下面挖空了那你这块怎么控制阻抗呢?
    ! B5 k& u5 |7 h3 r8 |(貌似你底下走了这么 ...

    ) s" `4 k/ X" u5 g* N$ [+ C) S: f  e5 P, b

    R@6H{}ZFJYQB$5O%8ES{_HP.png (86.56 KB, 下载次数: 2)

    R@6H{}ZFJYQB$5O%8ES{_HP.png

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    板子就这么大,那个是固定位置这样放的  详情 回复 发表于 2017-5-26 11:17

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    14#
     楼主| 发表于 2017-5-26 11:17 | 只看该作者
    1 {% t/ T! M6 i; P* _: b
    板子就这么大,那个是固定位置这样放的
    7 O; W7 ]; n# D( t/ ?) Y6 A

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    15#
    发表于 2017-5-26 17:37 | 只看该作者
    不知道你等长是怎么做的? 看图示外面那两线相差很大啊,靠板边绕个大圈倒数第二根最长的是DQS吧?
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