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[仿真讨论] [求助] ddr4 中的 data training 是什么意思

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1#
发表于 2016-11-15 17:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位老大,
4 N/ p6 F6 u) U0 R0 C
* q0 R# `) z6 t' t    ddr4 中的 data training 是指什么, 看协议看糊涂了, 不是很理解.
! u. E7 o, \1 q* s) t' A

该用户从未签到

2#
发表于 2016-12-9 07:42 来自手机 | 只看该作者
可以理解成数据信号的一个自适应接受的过程,ddr4的数据信号参考电平是不固定的,所以判决门限也不固定,在系统启动的时候就要自适应的去找这个门限,使得数据眼图最优化。
  • TA的每日心情
    郁闷
    2019-11-19 15:44
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    [LV.1]初来乍到

    3#
    发表于 2016-12-23 13:13 | 只看该作者
    training是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。

    点评

    可以调delay的话那不是不用做等长了?  详情 回复 发表于 2017-1-13 15:11

    该用户从未签到

    4#
     楼主| 发表于 2017-1-13 15:11 | 只看该作者
    ljzyhjbfwh 发表于 2016-12-23 13:13
    5 L' @% q% q: P- n. b/ ]training是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。

    6 Q; l3 `# A! k2 r/ C# C可以调delay的话那不是不用做等长了?
    : Z, H; q, M% j0 g* H5 Q* m$ _$ l

    点评

    等长还是需要做,内部调delay有个范围,超多了,就调不到align了。  详情 回复 发表于 2017-1-16 13:45
  • TA的每日心情
    郁闷
    2019-11-19 15:44
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    [LV.1]初来乍到

    5#
    发表于 2017-1-16 13:45 | 只看该作者
    l888888h 发表于 2017-1-13 15:11' A  J3 q* v- M3 I
    可以调delay的话那不是不用做等长了?

    $ T7 M) `' K. x4 `. {# Y* u2 X  E等长还是需要做,内部调delay有个范围,超多了,就调不到align了。$ S9 f/ v, w2 U4 C# N

    点评

    内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?  详情 回复 发表于 2017-1-16 19:50

    该用户从未签到

    6#
     楼主| 发表于 2017-1-16 19:50 | 只看该作者
    ljzyhjbfwh 发表于 2017-1-16 13:45
    * ?: A& n2 l* U- g! B) T- u等长还是需要做,内部调delay有个范围,超多了,就调不到align了。
    & B$ n& m2 g' y: {) q6 N  M
    内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?2 N: ?0 C! V( j- A7 j4 P

    点评

    协议上没有。  详情 回复 发表于 2017-1-17 14:02
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    郁闷
    2019-11-19 15:44
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    [LV.1]初来乍到

    7#
    发表于 2017-1-17 14:02 | 只看该作者
    l888888h 发表于 2017-1-16 19:50
    9 D1 X, K) @2 J. I7 E内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?
    ( {8 m/ `% t; |$ n4 c# B8 t0 d
    协议上没有。- o  Z4 d* F' l% Z

    该用户从未签到

    9#
    发表于 2017-3-18 10:14 | 只看该作者
    有ddr4的文件吗?能不能分享下1145441303@qq.com,多谢
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