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发表于 2015-11-16 22:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 Eric71 于 2015-11-17 11:31 编辑 9 `& K% w; u4 R" Q+ G. h1 k9 w$ n

, J" y2 F4 ~* a# y* n& b4 A模擬時有這問題如何處理 ?
0 C& v. m9 y- B2 h7 H# C6 u, H2 T9 V) v5 K5 H
8 v; ]+ E5 G7 l
<<更新問題 >>* h, E7 N- K  J* X/ f5 I& `, Q. D

' u2 q+ U. A' G; i1 ~
/ e9 C3 ]" _% s& i4 s  @, z  n' O6 t5 e" p3 i( I  t6 m
**** 11/17/15 11:29:42 ******** Pspice Lite (June 2009) ******* ID# 10813 ****3 i4 u" y5 O+ M1 {, l( G+ k+ O

! V, [/ f! Z* _; J1 I' v+ Z! N ** Profile: "SCHEMATIC1-Small Signal"  [ D:\cadence SPB\HomeWork\實驗4-6-pspicefiles\schematic1\small signal.sim ] + y% o; f% B: D! @1 H

& ^$ m( v* u9 A
- X' g& T: L. j* z! b ****     CIRCUIT DESCRIPTION
& Y. p- J+ s, L* T( i, \0 P4 B- x, [0 b, f

4 ^" x) ~4 U! b: z3 g& U% ]! u% _******************************************************************************1 X, d8 T/ F: @! }% F

, v* ~$ a- w8 Y2 b. B! I  l& u
5 G& U( z, m9 z3 h! v6 x0 H. o6 F* f* t, ~9 s/ \% ]0 i8 ?

# T( x+ j+ i; ^. ]** Creating circuit file "Small Signal.cir"
8 p8 j8 @7 h' B* o& h** WARNING: THIS AUTOMATICALLY GENERATED FILE MAY BE OVERWRITTEN BY SUBSEQUENT SIMULATIONS) r  k: t& p& w" f* P3 s8 P
8 F$ Y- N. O# e
*Libraries:
& u; u9 v" \9 Y% p* Profile Libraries :
3 T& j  o: b* W- t+ G! S* Local Libraries :
$ z" r% a3 V& a- b. y, M* From [PSPICE NETLIST] section of C:\Cadence\SPB_16.3\tools\PSpice\PSpice.ini file:8 H5 M" Y5 A  B: M. C$ w) \
.lib "nomd.lib" 5 M! J) o$ R' w* B

: X) w5 x. |4 O4 u' S* ]+ A*Analysis directives: . P: P6 X; Z7 u& k) i! J6 U! t
.DC LIN V(Out) -3V 3V 0.1
* [$ X* f+ D8 q8 S1 H! A----------$* i! f+ @. N* N0 |2 V
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5 y+ w- j3 \1 i. m. Q7 T7 S0 T2 |" B" ].PROBE V(alias(*)) I(alias(*)) W(alias(*)) D(alias(*)) NOISE(alias(*))
0 [+ d. K( B. v.INC "..\SCHEMATIC1.net"
" K! j* f- U6 ?- ?; p, Q! J5 ?0 x; |& S7 y" A; a( r
1 N* M" y7 c( H; S5 P  Q0 a/ ?
# [- k1 B/ j1 b4 e" s$ G
**** INCLUDING SCHEMATIC1.net ****
+ C2 ^: Z/ O* n* source 實驗4-6
: O* M, X/ z& ^, i1 r# }/ rV_V3         VCC 0 DC 5v  ! Z8 s8 f, }& G
V_V4         VDD 0 DC -5v  ) n0 U' j9 e5 N
X_U1         N00284 0 VCC VDD OUT uA741
5 p+ ~5 L+ u) Y" U) iV_V1         N00305 0 DC 1v  
) l& [- R, E" D4 M# C+ }V_V2         0 N00298 1v
' G! P# q3 r. X& T8 m0 b9 v/ eR_R1         N00305 N00284  5k TC=0,0 ' h" @( f: U3 S4 b" b2 _
R_R2         N00298 N00284  5k TC=0,0
" E% I6 p( d2 v) MR_R3         0 OUT  5k TC=0,0
! u* j8 K8 D4 t- MD_D2         OUT N01053 D1N750
" z+ Y* j  I1 KD_D1         N00284 N01053 D1N750
" J5 c' ]. p/ `7 \' O* p: V& V1 ]( ~' _; }) F, J# U: z* N
**** RESUMING "Small Signal.cir" ****' ]& x; R0 Y8 E' |1 B7 h
.END
  g6 a8 j  P+ Z" e
+ b7 J' D, ]9 }7 e2 i: |: t3 a; `8 Q  c4 j+ n
( i+ x" u- w9 p4 ^& h# b

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2#
发表于 2015-11-17 09:36 | 只看该作者
ERROR 通常是指上一行列有問題,不是ERROR的下一行列有問題。這樣看不出來問題,最好是ERROR前後都貼出來,這樣才好判斷。

点评

謝謝大大~~ 我更新問題了,這問題出現很多次模擬不出來~~  详情 回复 发表于 2015-11-17 11:33

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 楼主| 发表于 2015-11-17 11:33 | 只看该作者
jacklee_47pn 发表于 2015-11-17 09:36
/ `5 O7 A  ~" K# LERROR 通常是指上一行列有問題,不是ERROR的下一行列有問題。這樣看不出來問題,最好是ERROR前後都貼出來, ...

9 \8 Q/ ^( b9 S; ]2 c. q/ Y謝謝大大~~ ' ~$ t8 E% u6 C  o+ f" X

/ o( j9 p! D! m. C我更新問題了,這問題出現很多次模擬不出來~~0 f; R) P' c- |5 H; p4 G# m

* ]7 [4 i! J+ t: L

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4#
发表于 2015-11-17 12:44 | 只看该作者
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