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发表于 2015-11-16 22:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 Eric71 于 2015-11-17 11:31 编辑
# F. z4 ~) Q* E2 {- f% J9 L7 T  M9 i
模擬時有這問題如何處理 ?
& `( B5 x7 Z- \0 n7 R0 [7 ?2 @$ b9 B. m- ?. _

1 ^, }1 b3 }8 K# w<<更新問題 >>' \( x% F( g) i
6 L( j& f3 |  b5 g

2 O0 Q5 m% f9 h7 A% c( L! B3 n% J: _
**** 11/17/15 11:29:42 ******** Pspice Lite (June 2009) ******* ID# 10813 ****% P: e8 F6 {* X% n

* X# Z8 i0 R" E ** Profile: "SCHEMATIC1-Small Signal"  [ D:\cadence SPB\HomeWork\實驗4-6-pspicefiles\schematic1\small signal.sim ]
5 c5 z4 k1 f) E4 R3 `# F
, k- a9 ~0 r% U0 o( n
; D* z3 g/ \& j5 c8 c) t- i) p; q& T' m ****     CIRCUIT DESCRIPTION
4 _  n- [- f9 t3 F; w! b! y; |9 y6 C+ m5 m4 `4 {* a, I% N4 x, R, M

% Q- Z$ U: [* |+ u******************************************************************************
. ^) u* f. u. i3 W% V
# ]9 Q& E1 m0 i, z  L
8 @; S8 S6 ?+ K+ U- f5 z) h) @
0 R3 E+ V. h3 s( o) J5 `$ q* y$ {, g- H) p% Y; c
** Creating circuit file "Small Signal.cir"
) f# y; o0 |+ X2 @) V) u! B** WARNING: THIS AUTOMATICALLY GENERATED FILE MAY BE OVERWRITTEN BY SUBSEQUENT SIMULATIONS
  W& F3 e! R0 k# I7 M
- \0 k, f3 y7 F*Libraries:
. V- Q0 O/ z5 J* a) c* Profile Libraries :% t) [5 D/ S( V! h5 Q/ q
* Local Libraries :% a4 ]- p1 s" ^% d$ D% p
* From [PSPICE NETLIST] section of C:\Cadence\SPB_16.3\tools\PSpice\PSpice.ini file:
" t9 ?: L! t7 S( Z6 J* ^.lib "nomd.lib"
; E# ?4 j: a: c# R" B! v' A2 ^+ s, i$ k  ]
*Analysis directives: ) U1 i+ r! B1 E# Y8 z6 I
.DC LIN V(Out) -3V 3V 0.1 & ~. S6 H" ^$ w8 R+ k& D
----------$
! u8 T( u' m- C' `3 \ERROR -- Invalid number  L: M( W* _2 e, Y
.PROBE V(alias(*)) I(alias(*)) W(alias(*)) D(alias(*)) NOISE(alias(*))
  Z- K+ S3 w6 B' f# B) d8 N.INC "..\SCHEMATIC1.net" ' K# B/ r# K# u, [0 x1 R+ `
4 H  F; H0 i5 g" ]+ |/ H9 Y% j
6 O- S+ `. j6 @0 d- I$ L7 h' p7 X

0 ?- V' W' c! l" Y$ r+ F**** INCLUDING SCHEMATIC1.net ****" \% B- J6 i& q9 b9 _- j7 g
* source 實驗4-6
+ ~( m$ X8 I( y2 {2 c7 b/ ?) ZV_V3         VCC 0 DC 5v  $ J' l9 @. }8 `" C' S9 c/ V
V_V4         VDD 0 DC -5v  9 c- H6 Z9 \& J
X_U1         N00284 0 VCC VDD OUT uA741
$ F: Q9 x* I  F7 w6 [1 v. S" U" kV_V1         N00305 0 DC 1v  ; g* S0 }: L4 u6 ~( K4 j, j& c
V_V2         0 N00298 1v3 O5 m" p! \1 {- R/ I9 I/ t
R_R1         N00305 N00284  5k TC=0,0 " K" `9 [6 `/ H2 T' V6 S& H) H2 b$ B
R_R2         N00298 N00284  5k TC=0,0 3 Q; K) X- t' O* m+ T
R_R3         0 OUT  5k TC=0,0 : \# m% a$ {. k2 V8 O
D_D2         OUT N01053 D1N750 3 P; r1 [9 k+ y" X
D_D1         N00284 N01053 D1N750 % h" N, y, a- F' A3 v) Y* m# q

" l* q3 G( W- r8 D**** RESUMING "Small Signal.cir" ****( s4 \  Q* f* [0 n, E' N- `6 h
.END
! j, r* r" a) R+ e; `  p+ x1 L' w; g0 \ 0 w3 x9 c$ ]5 d0 R- f9 a# b
. o9 L5 H" p2 W# b. }9 V
2 `* p# A  D% O

電路圖.JPG (52.75 KB, 下载次数: 2)

電路圖.JPG

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2#
发表于 2015-11-17 09:36 | 只看该作者
ERROR 通常是指上一行列有問題,不是ERROR的下一行列有問題。這樣看不出來問題,最好是ERROR前後都貼出來,這樣才好判斷。

点评

謝謝大大~~ 我更新問題了,這問題出現很多次模擬不出來~~  详情 回复 发表于 2015-11-17 11:33

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3#
 楼主| 发表于 2015-11-17 11:33 | 只看该作者
jacklee_47pn 发表于 2015-11-17 09:36
/ P- t+ y6 S+ [. Y  Z  a$ ~ERROR 通常是指上一行列有問題,不是ERROR的下一行列有問題。這樣看不出來問題,最好是ERROR前後都貼出來, ...

4 R. o  Q8 }/ U謝謝大大~~
9 p" o: r1 [# Y/ W
1 U. u+ t" `  a! e我更新問題了,這問題出現很多次模擬不出來~~
4 w  E+ c. a# n" P. B9 ~
1 @9 O! `" }& b# n9 q

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4#
发表于 2015-11-17 12:44 | 只看该作者
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