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PCB edit 中修改及添加Net的方法

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发表于 2015-9-28 17:06 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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环境:; N1 o* A3 b* K2 t/ B" p, a
        1、cadence 16.6 x86; ! Q' O$ V; ^  s) u& I
方法步骤:
3 ^5 [, ^' c# Z+ q        1)1.设置。setup/User preferences editor
  o- Q; r# S. {        将默认的保护开关打开,如下图所示:0 x4 G* }# @. T3 b7 n% P. X! H
         6 `+ f# P0 @& ]+ e+ O, h
        可以通过搜索功能找到“logid_edit_enabled”5 M8 o0 Q; y) o$ m$ ?
2)  运行修改网络Logic/Net Logic命令,可操作项目如下图所示* j5 D- a( }! e
       & \8 {# f; p: {
     在此窗口当中,可以发现可以对net进行产生,重命名,删除;, A; P- O! a1 {2 a
1 z& y. \6 q) C: n% h. ^

8 U9 z; H  t; b' T8 K2 M# q0 P
- t/ h. h1 k* @1 o: A5 r
" u$ o$ O. [# q, p' J3 @! M, h" e

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2#
发表于 2015-9-28 17:33 | 只看该作者
这样更改完后,原理图会有什么变化吗

点评

对原理图没有影响,但是改变了PCB文件的网表。 在原理图和PCB分别由不同的人设计的时候,这种做法不提倡的。  详情 回复 发表于 2015-9-28 20:04

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3#
发表于 2015-9-28 20:04 | 只看该作者
阿斯兰 发表于 2015-9-28 17:333 X4 O" ]# Z# O, K2 C) i6 b
这样更改完后,原理图会有什么变化吗

* c$ w& i1 c5 g+ [* q5 P对原理图没有影响,但是改变了PCB文件的网表。
" v2 Z" o+ q2 y; n在原理图和PCB分别由不同的人设计的时候,这种做法不提倡的。
" }, d* n- I% Y( s

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4#
 楼主| 发表于 2015-9-29 08:32 | 只看该作者
我主要用在下面的情况:
7 u* L- `8 u/ T 1、NC 引脚,但是在原理图中没有,但是在PCB中有。画PCB时又想把这些引脚又想接地,不知道在原理图中不修改PART的情况下,怎么修改?所以就想了这么一招;, g- v/ f$ F- Q2 \' z" ^6 E
" l" G+ m( O' L
当然建议最好不要这么做。

点评

引脚不对应的话,网表怎么导入的?  详情 回复 发表于 2015-9-29 09:15

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5#
发表于 2015-9-29 09:15 | 只看该作者
qqtolm 发表于 2015-9-29 08:32
. B4 s! s% c8 X5 S$ p我主要用在下面的情况:
/ W7 Z( ~# }7 D4 N/ K! M3 w& ? 1、NC 引脚,但是在原理图中没有,但是在PCB中有。画PCB时又想把这些引脚又想接 ...
" M6 J& Q& D% g8 Q/ u. z
引脚不对应的话,网表怎么导入的?4 C3 @1 @, ?; W- T

点评

方法是原理图中选中PART,打开属性页。 增加NC名称,将对应的空引脚写入即可。 [attachimg]102841[/attachimg] 我现在的问题是不知道如何将这个NC引脚接地。  详情 回复 发表于 2015-9-29 10:30

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6#
 楼主| 发表于 2015-9-29 10:30 | 只看该作者
chrysalis 发表于 2015-9-29 09:15
( h$ C# q6 w& S9 i引脚不对应的话,网表怎么导入的?

8 ?5 l( {7 z: d! x3 E方法是原理图中选中PART,打开属性页。
$ w$ e, X( _# n3 \7 q增加NC名称,将对应的空引脚写入即可。2 N$ D' Y7 M- t3 t0 [4 a0 ]
: D3 G0 n: @4 D1 g
) i8 ?2 T$ O# a- Y
我现在的问题是不知道如何将这个NC引脚接地。1 x% G6 G5 [) x' @* l8 w# g6 Y

+ \3 Z7 d5 W7 O- J- H- C

点评

看来是原理图规范不一样,我见过的原理图的part没有NC属性,NC pin都是给了个Place no connect  详情 回复 发表于 2015-9-29 10:58

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7#
发表于 2015-9-29 10:58 | 只看该作者
qqtolm 发表于 2015-9-29 10:309 J6 w8 }  \/ \' E# v
方法是原理图中选中PART,打开属性页。
% {7 R, S1 z# _* n7 j/ a增加NC名称,将对应的空引脚写入即可。
, o: v% U  s( p/ @
看来是原理图规范不一样,我见过的原理图的part没有NC属性,NC pin都是给了个Place no connect4 S4 j2 }. y; e  ]; l) g

点评

NC 属性是可以自己添加的。你可以在帮助中了解一下  详情 回复 发表于 2015-9-30 08:43

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8#
 楼主| 发表于 2015-9-30 08:43 | 只看该作者
chrysalis 发表于 2015-9-29 10:58, |3 b: S" P0 {  c: ?
看来是原理图规范不一样,我见过的原理图的part没有NC属性,NC pin都是给了个Place no connect

. A& J2 V: ?% b( X& q0 ONC 属性是可以自己添加的。你可以在帮助中了解一下

点评

我知道可以自己添加,但是我见到的原理图都没有添加这个属性。 添加了NC的pin和直接连到place no connect(在原理图上就是连上了一个×)有什么区别吗?  详情 回复 发表于 2015-9-30 09:27

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9#
发表于 2015-9-30 09:27 | 只看该作者
qqtolm 发表于 2015-9-30 08:437 H/ ^# o0 Q; n, Y5 {3 O
NC 属性是可以自己添加的。你可以在帮助中了解一下

3 K- _0 F# x$ n0 b0 [# C4 M我知道可以自己添加,但是我见到的原理图都没有添加这个属性。
# x& A9 M% {0 ^( @" U( t0 h# @4 b$ T添加了NC的pin和直接连到place no connect(在原理图上就是连上了一个×)有什么区别吗?! Z: {* z3 W. R) g, p% P# ]: Z

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不是一会事。使用NC引脚是因为原理图和PCB封装不对应:PCB中有多余的引脚后原理图中没有;  详情 回复 发表于 2015-9-30 12:18

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12#
 楼主| 发表于 2015-9-30 12:18 | 只看该作者
chrysalis 发表于 2015-9-30 09:27$ s. T& e# C5 a: [7 ]6 L
我知道可以自己添加,但是我见到的原理图都没有添加这个属性。) m* Y- h2 T6 d2 ?5 ~, k
添加了NC的pin和直接连到place no connec ...

! p4 F  |) v# q. e3 ]不是一会事。使用NC引脚是因为原理图和PCB封装不对应:PCB中有多余的引脚后原理图中没有;
- z# A: \0 q& d
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