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设计好的PCB如何检查等长的问题

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发表于 2015-9-25 14:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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一个主IC挂两片DDR,主IC到DDR使用T型结构分出,要求是主IC分别到DDR的网络等长,设计的时候使用的是虚拟过孔,设计完成后如何检查符合要求。还有DDR3做等长200mil以内可以吗?
) O, m. N, W# U1 d" r; s$ Z

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2#
发表于 2015-9-25 15:28 | 只看该作者
设计完成后输出等长表格后,检查等长数据。% D4 t6 a0 M0 Z) X! T% k$ [

. Z( B3 |# o# t' B' x地址线等长200mil没有问题。

点评

请问jimmy 输出等长表格是这个吗?  详情 回复 发表于 2015-9-25 23:13

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3#
 楼主| 发表于 2015-9-25 23:13 | 只看该作者
jimmy 发表于 2015-9-25 15:28$ X7 t- `( Q: I1 M" I# E9 U, p
设计完成后输出等长表格后,检查等长数据。
3 R4 y' Z3 v3 R" }/ p! W) L
2 ^- [  [% q9 {5 {7 l$ r地址线等长200mil没有问题。
3 ]2 [* c: d2 y" q  v( k
请问jimmy 输出等长表格是这个吗?
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4#
发表于 2015-9-28 09:47 | 只看该作者
对,是的" G- H3 G% `. L: d6 F

! K2 ?" \- B9 V1 o详情可参阅《PADS9.5实战攻略与高速PCB》一书。
' {- B3 O, @) j  I$ P5 Q) O* r
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