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[仿真讨论] DDR2地址线仿真碰到的问题

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1#
发表于 2015-9-23 11:16 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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平台情况: Freescale MPC8313 powerPC cpu,挂载2颗DDR2颗粒,micron的MT47H64M16HR,为了省成本,没有将地址线上拉到VTT
2 o/ Z8 F4 s& d* [( ?7 Z+ S. Y背景介绍:我们信号完整性部门测试DDR2的地址线和Cammond线的overshoot/overshoot area超标,软件已经将驱动能力设置到了最低,实际测试波形如下 由图片可知,undershoot虽然看上去有俯冲,但是没有超标,overshoot看上去没有过冲,但是却超标了,再仔细看图片,原来波形的高电平竟然达到了1.9V,而示波器的软件是按照1.8V作为参考来计算overshoot的,所以问题出现在高电平的幅值上面,我推测原因是因为没有加VTT上拉。/ d9 B. P$ u3 l6 T
于是我利用刚刚学会的反射仿真来是试一把,可是,现实非常地打击人啊:(,下面是仿真碰到的问题,请大神帮忙分析:+ v7 u0 C3 c9 k3 u4 H( o( w5 \- U5 J
1)我在allegro里面设置好元器件的model,然后直接将网络的topology拽到Sig xplorer里面,仿真出来有两个地方都和实际波形不符合,第一个就是上升沿竟然也有很大的俯冲,第二个就是,最终电平竟然稳定在了1.8V
9 ~# i: q4 j. z3 f2)我打开sig xplorer,直接在里面构建拓扑,仿真出来,电平倒是稳定在了1.9V,和实际测试差不多,但是上升沿还是有过冲,和实测不符合。7 v) _/ H% y( `
求大神帮忙看看我哪里出问题了,折腾了2天了,哎9 E, w6 T/ e* W3 i7 k6 I. O
多谢多谢8 b, F4 X2 M( R3 T3 T

7 ~7 l( x! }7 i3 C3 c

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发表于 2015-9-25 13:36 | 只看该作者
楼主,你好,能不能描述下如下问题
$ A1 H( l( I) y) ~, {2 B4 C1 给出你所测信号的拓扑结构图,各个部分的线长最好标注下( r  b- C4 D5 y' X$ n1 h
2 给出你测试波形上的测试点,就是说你整条链路上的哪个点测试得到的波形( @& v( `; ~  ~1 R: K/ r) _. v
3 实际ddr运行的参数设置,比如driver设置的是什么类型等
- K- u+ E1 h6 U" q5 U9 i0 G( ]$ B, d: E: e4 说下你的测试条件,比如示波器带宽,探头选择等

点评

这个回复点赞,这才像解决问题的样子  详情 回复 发表于 2015-9-25 14:08

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2#
 楼主| 发表于 2015-9-23 11:25 | 只看该作者
呼唤大神们啊

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3#
发表于 2015-9-23 12:01 | 只看该作者
这个就是实测和仿真的差距。有这种差异是很正常的,毕竟你的参数设置不一定一模一样,另外,你的设计DDR2的仿真和测试所使用的模型(实际使用寄存器改变,仿真是手动调整)有可能还不一样。后面的就看你自己悟了。

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4#
发表于 2015-9-23 13:26 | 只看该作者
有些情况是仿真不出来的,你的供电电压是不是太高了

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5#
发表于 2015-9-23 13:32 | 只看该作者
从图上看,上升沿比下降沿缓,所以下冲要比上冲严重,那么上冲不明显就可以理解了

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6#
 楼主| 发表于 2015-9-23 13:55 | 只看该作者
我的DDR VDD是1.8V,很准确,我测量过了。为什么地址线是1.9V?,难道是由于探头的接地点选择的不好?有电压轨道跌落?

点评

这与你的VDD有什么关系呢?照你这样说,电源正确,板子就不会有问题了。  详情 回复 发表于 2015-9-23 16:14
我猜是你的驱动电压设置问题。  详情 回复 发表于 2015-9-23 15:54

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7#
发表于 2015-9-23 15:54 | 只看该作者
windrobust 发表于 2015-9-23 13:551 m" c4 b$ `( z+ o. u+ V  R; }
我的DDR VDD是1.8V,很准确,我测量过了。为什么地址线是1.9V?,难道是由于探头的接地点选择的不好?有电压 ...

, x; e: \% S# O. y0 i# C, J  @1 W: Y我猜是你的驱动电压设置问题。6 O; r0 y. C$ o& j  h3 l/ O

1 Z/ f1 C2 n! ~3 z4 U" p% P' m

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8#
发表于 2015-9-23 16:14 | 只看该作者
windrobust 发表于 2015-9-23 13:55: `  O4 M. f9 r
我的DDR VDD是1.8V,很准确,我测量过了。为什么地址线是1.9V?,难道是由于探头的接地点选择的不好?有电压 ...
/ N1 I/ _) [' I* _1 Q/ |- H8 ]. w: }
这与你的VDD有什么关系呢?照你这样说,电源正确,板子就不会有问题了。

该用户从未签到

9#
发表于 2015-9-23 22:24 | 只看该作者
VDD电压很稳跟号信的Overshoot没有必然的关系,Overshoot过高只与信号线的匹配程度有关,匹配的好,Overshoot较低,反之则高。上升和下降沿本身存在速度不一样,那是与Driver端上下MOS的开关速度不一样有关。仿真的结果与测量值之间的不一致,应该考虑你的模型是否精确,以及信号线建模是否精确有关。

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10#
发表于 2015-9-25 11:08 | 只看该作者
都不实际跑下仿真就给建议,果然都是大神,然后结果呢?问题怎么解决呢

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12#
发表于 2015-9-25 14:08 | 只看该作者
icy88 发表于 2015-9-24 17:36
: d: @, Y# m+ \! J3 [3 Y: N3 {楼主,你好,能不能描述下如下问题
# Y( v. n" {) c7 p* ^1 给出你所测信号的拓扑结构图,各个部分的线长最好标注下
5 Q) T0 B/ ^8 q: q, @2 给出你测 ...

( \7 ?4 V% |3 `8 p3 U* l! X这个回复点赞,这才像解决问题的样子1 e$ K7 d  `3 e5 i

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13#
 楼主| 发表于 2015-9-26 12:37 | 只看该作者
icy88你好,抱歉,你回复的如此神速,以至于我没有看到你帖子,还是别的兄弟引用我才注意到1 z) Q$ G8 Z8 j$ O' d% `1 K
我的topology如下图所示:$ O7 o8 i. V7 Y$ u

8 P. L6 X& {& t) f8 ?0 R7 k% C6 M示波器的探头是放在了VIA11,或者VIA12上边- s: G4 f3 T) e; R0 Q
DDR2的driver已经通过软件设置到了minidriver,仿真的时候也选择的minidriver模型3 J4 x7 j# F  w! [
示波器的和探头的带宽都是12G,实际测试波形如下 :% x0 g/ B% @5 @% g
! W( M4 A* F  z4 R' g( E

点评

不好意思哈,最近都没怎么上网,我看了下你的结构,我这边试着搭建了一些拓扑结构,也是会存在过冲的问题的,所以仿真方法上应该没有什么问题。至于仿真出来的波形和实际测试的不符,可能有很多的原因,上面也  详情 回复 发表于 2015-11-2 15:41

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14#
 楼主| 发表于 2015-9-26 12:40 | 只看该作者
另外,需要说明如下,软件设置驱动能力最小,实测波形和仿真差距比较大,软件设置成HSE模式(这个模式按照规格书就是最小驱动模式),实测波形和仿真比较类似,但是过冲的幅值不太一样
5 a- A/ k) Z# ]5 z' }6 |3 N* [, @3 O

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15#
发表于 2015-10-12 23:59 | 只看该作者
了解啦,谢谢
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