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Signal model 导网表报错,求解答!

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发表于 2015-9-7 14:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问,allegro Design Entry HDL 的原理图导pcb的时候,( o9 q6 |! q/ L' ?- F% u; S  T  ~0 V
报很多“Signal model 'R0ohms' not found; may effect xnets and electrical constraints.”的错。
" t( G6 U! e# p0 U7 f请问有没有方法不报错,或者不导模型的信息进pcb。
) j7 S: M3 S, t, O5 c! U6 P3 ~6 X& b) E8 _' }. i3 d
请知道的大神们解答我一下啦^_^: p4 b; \* }. S+ }" ]

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发表于 2015-10-11 09:35 | 只看该作者
START_ECSET_MODELS
$ c4 ^- {4 Z; V* p3 T& D9 eretain_existing_xnets_and_diffpairs 'ON'3 ]* w2 k! z# a$ c8 l3 B1 D9 v- P( k
END_ECSET_MODELS$ H2 k6 h: z% B

' v6 Q' z* |; U$ P" O* I" `2 _工程文件cpm最后加上这个

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