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DDR2/DDR3的等长线是如何进行分组的?哪一组的优先级最高?

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1#
发表于 2015-5-1 17:25 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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DDR2/DDR3的等长线是如何进行分组的?哪一组的优先级最高?谁能具体说下!  A! W5 ], n4 A5 J  y% ~4 ~

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2#
发表于 2015-5-7 15:03 | 只看该作者
以下三本书都有详细介绍:/ ^1 }, R7 h, @
<PADS9.5实战攻略与高速PCB设计>319至409页# U2 k, Q/ o) U/ Q& k
<Mentor Expedition实战攻略与高速PCB设计> 353至400页/ g" z) Y0 J* z: w4 x- \( o
<Altium Designer实战攻略与高速PCB设计>15-16章
; c' p0 K4 H4 v+ i9 n$ Y7 V$ k8 ]" G6 R* i6 F1 ~

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3#
发表于 2015-5-7 15:10 | 只看该作者
这本书我看过好像还不错
% n# z7 e& w, p4 u# T) x2 }, e- }

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4#
发表于 2015-5-7 15:20 | 只看该作者
低8位数据线一组
0 G, c  P1 W. `' y高8位数据线一组1 O. k) _$ F# F
地址,控制,时钟为一组
( J/ m  p6 D' [
" }% n6 K# O: y: R时钟>数据>地址,控制

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5#
 楼主| 发表于 2015-5-11 22:33 | 只看该作者
多谢Jimmy大师回复!追问一下,是不是同一个组的走线最好放在同一层上?

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6#
发表于 2015-5-12 14:12 | 只看该作者
<Altium Designer实战攻略与高速PCB设计>这本书什么时候可以买?
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