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有没有满足我以下要求的D触发器芯片?

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1#
发表于 2015-4-7 11:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
4片AD同步采集,有同步采样时钟。现在我想把FPGA出来的1路SYNC信号同时给4片AD的专用SYNC管脚,4路SYNC信号要求彼此同步,且和4路AD的采样时钟保持同步。2 M& P$ G; b5 C0 i! m7 F

! G; y' r& o2 \4 m我的想法是FPGA出来的SYNC信号经过D触发器后,会和采样时钟同步,再给AD芯片。) T( u5 o/ N8 K: i8 N( Z
那有没有这样的D触发器芯片:1路差分时钟输入,1路D输入,4路Q同步输出?$ ?/ }; A1 c9 h# i+ s
或者说上述要求是不是已经不叫D触发器了,而应该是数据分配或者扇出驱动啥的?如果是请推荐下相关芯片,谢谢!9 w& y8 }5 W0 u' R5 q$ U

该用户从未签到

2#
发表于 2015-4-9 00:23 | 只看该作者
本帖最后由 超級狗 于 2015-4-9 00:24 编辑 % L) @( {8 `: ~7 W

2 x, D! [+ l! F, k7 |, Z
  • 扇出能力夠大的話 1 推 4 就可以了。
  • 即便是四個不同的 D 型觸發器,延遲時間也是 ns 級的,你的同步需要這麼準嗎?(採樣速度如果是 GHz 級,就當我沒講過!
  • 好啦!如果你就是堅持要這麼準,有一種叫 Zero Delay Clock Buffer 東西或許可以考慮,1 分 4 輸出、各組間的差距是 ps 級的。很多家都有,踢哀(TI)、暗!蝦密(On-Semi)、賽普瑞斯(Cypress)、陪你看(PERICOM)………。
    4 N- S% }+ G) r% o& T
; B  y2 i/ C5 o& |9 O
Silicon Labs Zero Delay Clock Buffer Selection Guide) G4 W% \4 Y7 Y+ Z( B7 z  _0 V

clock-buffers-quick-reference.pdf

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