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orCAD to Allegro有关Footprint的一点疑问

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1#
发表于 2008-9-5 14:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
小弟画好了原理图,其中一个0402的电阻在原理图中Footprint设为R0402 ; Z2 k/ a7 c% ^2 T5 U, l% s
创建好网络表
/ r) _5 B9 u8 H4 g% e7 o# t 然后我做好了R0402的封装放到 c:\project\orcad\symbols 文件夹下面' j* D8 }# u8 f: J

( x& ?1 A! y6 dallegro中导入网络表后,摆放零件时发现没抓到封装R0402.1 J; [0 p) B, m" ~
请问我应该怎么设置,才能把封装好的零件和原理图关联起来,可以自动识别抓取?

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2#
发表于 2008-9-5 16:25 | 只看该作者
oRcad layout?! @; D: S6 a; y- |8 @3 [/ K0 ~7 o
还是allegro?

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3#
 楼主| 发表于 2008-9-5 17:29 | 只看该作者
用的是Allegro.一个人搞了两天了,好象也没相关资料可参考.

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4#
发表于 2008-9-5 17:42 | 只看该作者
原帖由 lxwuming 于 2008-9-5 17:29 发表
4 z( J: j; t' ~" f用的是Allegro.一个人搞了两天了,好象也没相关资料可参考.
8 H% v4 y; E4 q1 v. S# I
关键点:
9 \1 `; e8 o, d- q7 }/ z1.正确导出网表
5 ]5 o$ v$ D- h6 Q& C: u2.Allegro要设置正确psm和pad的路径,要包含你的封装和pad
0 d. Y) j8 p7 I, @* _6 v7 n
" Z6 ]% I, k' H( G3 q; M0 a对照上面,那个存在问题?

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5#
 楼主| 发表于 2008-9-6 09:11 | 只看该作者
numbdemon帮忙贴个图解释一下怎么设置psm和pad的路径的路径可好?/ i& K3 ]' k4 {9 q6 l0 e. x
刚接触,不是很清楚.用Project Manager吗?

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6#
发表于 2008-9-6 18:52 | 只看该作者

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7#
 楼主| 发表于 2008-9-8 14:21 | 只看该作者
Cadence Design Systems, Inc. netrev 15.7 Mon Sep 08 14:06:39 2008
. h9 ]( w- c, ]' C(C) Copyright 2002 Cadence Design Systems, Inc.
, j; z5 `" E  w" c6 l! k4 _------ Directives ------+ G1 I1 G5 M& d( o# N
RIPUP_ETCH FALSE;
! v5 Q. f5 S/ x/ C7 t2 qRIPUP_SYMBOLS ALWAYS;
4 t6 ?4 P% O0 W( `# b& v  l9 iMISSING SYMBOL AS ERROR FALSE;1 l' i1 a! y- b- [1 h
SCHEMATIC_DIRECTORY 'C:/project/orcad/forderix';
% B9 s1 c0 ?3 s$ N& ~( NBOARD_DIRECTORY '';' d. i6 {0 D1 Q: w
OLD_BOARD_NAME 'F:/Cadence/unnamed.brd';
, Q3 c: U( N& @9 H6 a/ aNEW_BOARD_NAME 'F:/Cadence/unnamed.brd';
6 x/ S+ \  ]- y0 L% J3 V7 iCmdLine: netrev -$ -5 -i C:/project/orcad/forderix -u -y 1 -z F:/Cadence/#Taaaaaa03428.tmp
! L$ f, t( r' ~% P. e------ Preparing to read pst files ------/ r3 ?% Y/ i* k2 a! t7 P" W) G

+ G0 H: y6 J4 _5 g. n! r#1   ERROR(24) File not found* A+ S! Z2 f1 z9 R4 i
     Packager files not found7 e/ W' L* H9 _& m" o+ E: v
#2   ERROR(102) Run stopped because errors were detected: \& O& W6 {; F% M' q
netrev run on Sep 8 14:06:39 2008
0 |" O' h! Y8 p   COMPILE 'logic'
7 }7 ~' l, f4 C+ Q   CHECK_PIN_NAMES OFF1 r% C$ q4 {& X7 X# ~
   CROSS_REFERENCE OFF- F+ Z+ X/ t8 ^. n. f3 T
   FEEDBACK OFF3 x7 m, f( X4 [% C- u. u
   INCREMENTAL OFF% T- A2 }) T' U
   INTERFACE_TYPE PHYSICAL
- X# K1 T& H7 s   MAX_ERRORS 500
. d7 o) H* F  Y0 {   MERGE_MINIMUM 5
# a+ A, G5 a, \; A- _9 Z8 m. w/ l   NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|'$ y% u8 ?9 v4 C0 V/ N
   NET_NAME_LENGTH 24
3 g( u7 |4 F5 \1 h. c. B4 P   OVERSIGHTS ON) a2 {7 E: X) Q$ X
   REPLACE_CHECK OFF7 b: t9 q% `" v. r
   SINGLE_NODE_NETS ON
, h$ }* _2 U# V5 f# |   SPLIT_MINIMUM 0
5 m- K' I; }: b. O, ^   SUPPRESS   20- e% _* g: D7 F* B" j$ u" o
   WARNINGS ON7 g7 Q( b, l+ b; p1 s
  2 errors detected4 _4 K6 ^, A4 E8 Z0 p4 Q
No oversight detected8 p+ i( \* R2 G- w
No warning detected! U/ e, M8 W8 f1 _
cpu time      0:00:039 R) ^& w5 m0 X9 t2 ^$ l6 S
elapsed time  0:00:00
: u' b# {6 g# r; t8 _0 {/ C
+ M5 f0 B6 p3 M3 X) s0 G5 }导入网表有以上错误,第一个错误我知道是没有封装,可哪个零件没封装怎么查找?
. D) d! `+ o$ X' e, s                                 第二个错误又是什么呢?: P; H# X  |# I- f# ]. d) ?! `/ B
还有netlist.txt又在什么路径下面?

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8#
发表于 2008-9-19 10:14 | 只看该作者
学习了,谢谢!

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9#
发表于 2008-9-19 12:43 | 只看该作者

回复 7# 的帖子

零件的封装可以这样看:& S2 N2 e) I7 b. e% W. [4 x
在design entry CIS 中点取 *.dsn,% V* g" v4 z9 u. \, p* m
                                tool-exprot properties
- R5 {- v- N7 e9 R然后在生成的*.exp(位于outputs) 文件里查看哪个元件没有封装。

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10#
发表于 2008-9-20 12:59 | 只看该作者
电子工业出版社的《Cadence高速电路板设计与仿真》这本书不错!!!!

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11#
发表于 2008-9-21 16:04 | 只看该作者

很好啊

我要学学啊
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