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[Cadence Sigrity] PowerSI阻抗仿真-Sigrity16.64初学者

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1#
发表于 2020-7-22 17:04 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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初学者,做了电源阻抗仿真:(1)仿真PCB上VDD3.3V,自动生成,端口可以进行仿真,并且也有结果(如图1);(2)但是,仿真模拟AVCC3.3V,自动生成端口,仿真报错,提示仿真设置错误(图2)。4 x1 o- f7 m( |5 D

微信图片_20200722170100.jpg (189.61 KB, 下载次数: 1)

(图2报错的日志)

(图2报错的日志)

微信图片_20200722170044.jpg (227.67 KB, 下载次数: 1)

(图1仿真结果)

(图1仿真结果)
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    [LV.8]以坛为家I

    2#
    发表于 2020-7-22 17:39 | 只看该作者
    查一下提示的焊盘参数,不能是负数

    该用户从未签到

    3#
    发表于 2020-7-23 10:09 | 只看该作者
    还不错,有结果了. p- b  l9 h+ O5 |7 l* o

    该用户从未签到

    4#
    发表于 2021-7-30 00:00 | 只看该作者
    powerSI阻抗仿真应该可以不用带VRM跑的呀
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