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allegro 走线疑问

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asdf193

发布时间: 2019-8-31 17:12

正文摘要:

请看图片，这是一个CPU往DDR上走的线，仔细看线上两边有铺铜，这对电路性能有什么影响，能有人解释一下这样走线的原理和好处吗？ s* ]2 y3 s# U4 m- N& w# @

asdf193 发表于 2019-9-1 18:15

https://community.cadence.com/ca ... with-tabbed-routing 这个网址里面有详细的说明

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emmashao

学习了多谢。详情回复发表于 2019-9-2 15:21

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asdf193 发表于 2019-9-2 11:30

jialebihaidao 发表于 2019-9-2 08:51# R, z5 U4 V9 q$ R8 E
控制阻抗的吧

是的，因为空间受限，所以增加这个形状，对电感没有影响，但是会和相邻增加容抗，以达到阻抗要求，这是INTEL出的，

emmashao 发表于 2019-9-2 15:21

asdf193 发表于 2019-9-1 18:15
, R( A* ?6 O0 v( ghttps://community.cadence.com/cadence_blogs_8/b/pcb/posts/next-generation-hs-routing-with-tabbed-rou ...

学习了多谢。

myhome43 发表于 2022-8-2 11:19

再跑DCR的時候調整阻抗用的~高速訊號會有連續不連續的問題~

wufan82 发表于 2022-7-19 09:10

线路宽度的变化会引起阻抗突变，这种设计是为了，阻抗匹配所设计

maychu 发表于 2022-7-19 09:09

學到新知識 .

莫妮卡 发表于 2022-7-19 08:57

用来补偿阻抗的

wyhnju 发表于 2022-7-18 10:58

请问还有网址吗？原来网址打不开了

“来自电巢APP”

Helen_jj 发表于 2019-9-9 14:57

cxt668 发表于 2019-9-1 13:56
: y3 d5 ~ c# o" l" o% P这个是怎么加上去的？

有专用的小程序加载输入命令就可以根据所需要的加上铜皮的长宽高

bingshuihuo 发表于 2019-9-8 17:14

服务器上有这个，阻抗匹配用的

155351394 发表于 2019-9-8 13:16

长见识

饕鬄翎鸶 发表于 2019-9-5 15:54

学习了

jccj_wan 发表于 2019-9-2 14:40

在intel的板子上经常看到，不明所以

jialebihaidao 发表于 2019-9-2 08:51

控制阻抗的吧

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asdf193

是的，因为空间受限，所以增加这个形状，对电感没有影响，但是会和相邻增加容抗，以达到阻抗要求，这是INTEL出的，详情回复发表于 2019-9-2 11:30

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