EDA365电子论坛网

标题: DDR4时钟波形问题 [打印本页]

作者: 七彩雨    时间: 2023-10-13 16:46
标题: DDR4时钟波形问题
DDR4仿真,共4片DDR4,时钟在第四片尾端端接,第三片DDR的时钟波形有点奇怪,如下图所示,请教大家是什么原因呢?
( R" e  d" x8 C' ]% A  _  f  {# |* s
4 R( w8 `; w7 v/ ~! P* J

作者: 七彩雨    时间: 2023-10-13 16:59
本帖最后由 七彩雨 于 2023-10-13 17:01 编辑 " A0 d; M8 V$ g3 @1 T. w% f  T

  B5 ]" u& X5 FC:\Users\admin\Desktop

捕获2.PNG (108.27 KB, 下载次数: 17)

捕获2.PNG

作者: Dc2023082110h    时间: 2023-10-14 09:48
好好学习,天天向上~~
作者: ldd2023    时间: 2023-10-16 10:27
前面两片呢?
作者: 七彩雨    时间: 2023-10-16 10:33
ldd2023 发表于 2023-10-16 10:272 Q8 H' A" Q9 M/ U+ b% j
前面两片呢?
* p9 {) f$ d9 D4 t5 q( t3 Y
前面2片,最后一片都正常  E( j: l3 j; P" N' J) ^5 j% G

作者: aarom    时间: 2023-10-16 17:57
提示: 作者被禁止或删除 内容自动屏蔽
作者: 七彩雨    时间: 2023-10-17 11:00
aarom 发表于 2023-10-16 17:57
) Q. j9 [, a0 U: @$ k3 l& `( Y終端電阻位置正確嗎??
% h. X9 T4 ?/ n5 K# H' ?
信号线尾端端接
作者: 6940    时间: 2023-10-17 13:17
电阻造成的! U9 h$ j( c, y0 d" k

作者: 七彩雨    时间: 2023-10-17 14:51
6940 发表于 2023-10-17 13:17+ I; A! f% ?. X  D0 J* w
电阻造成的
. S$ Y( d3 l3 T
能具体说说吗?- N* y  y1 _8 q: Z8 N! Q" j* `4 D

作者: aarom    时间: 2023-10-17 22:37
提示: 作者被禁止或删除 内容自动屏蔽
作者: 七彩雨    时间: 2023-10-18 16:09
本帖最后由 七彩雨 于 2023-10-18 16:21 编辑
( c. c, z8 Q. l
aarom 发表于 2023-10-17 22:37+ p" m( f& d1 b% A
1.不是用說的.沒圖沒真相.- F4 v& v7 q3 U7 P9 b
2.再來看你模擬是怎設的順序........
* P: a+ t8 e) a* d# J
时钟信号线依次经过四片DRR4,在第四片端接,仿真波形依次如下,第三片波形奇怪5 P3 n" e+ ?% _! `+ S' C9 t8 A  E: |1 B

. a  u; R* c$ j$ x# j3 C/ w. d. d0 a5 g, \: P( A& k- w& D

捕获u11.PNG (1.13 MB, 下载次数: 10)

捕获u11.PNG

捕获u9.PNG (1.13 MB, 下载次数: 6)

捕获u9.PNG

捕获u8.PNG (879.01 KB, 下载次数: 8)

捕获u8.PNG

捕获u7.PNG (1.25 MB, 下载次数: 9)

捕获u7.PNG

clk.PNG (391.48 KB, 下载次数: 10)

clk.PNG

作者: aarom    时间: 2023-10-19 00:18
提示: 作者被禁止或删除 内容自动屏蔽
作者: 七彩雨    时间: 2023-10-19 09:47
本帖最后由 七彩雨 于 2023-10-19 09:48 编辑 * o5 Y% n6 R! D' t; O+ @
aarom 发表于 2023-10-19 00:18
& a- \, A8 @0 X' |! v剛好被eda365 logo 檔到了.
2 Y$ G5 y* S+ j+ Y! q" [/ X: I3 [. {( s# q4 q
只看到沒拉等長.
5 _- M" j; U; j; e7 ^% a
做等长了,分段等长,A0-A16里包含有clk* s1 c$ b4 z, _

捕获-内层时钟.PNG (697.03 KB, 下载次数: 5)

捕获-内层时钟.PNG

捕获-等长.PNG (451.75 KB, 下载次数: 7)

捕获-等长.PNG

作者: 七彩雨    时间: 2023-10-19 14:13
七彩雨 发表于 2023-10-19 09:47
6 `5 I, k2 Z+ ?. q; C做等长了,分段等长,A0-A16里包含有clk

1 c2 e" ~2 T" Z5 S( x将端接电阻移到第三片旁,第三片仿真波形如下,感觉波形稍微正常一点了% G3 Z8 ]0 i2 e, N* X+ f

捕获u8-改.PNG (786.16 KB, 下载次数: 5)

捕获u8-改.PNG

捕获-时钟改.PNG (781.69 KB, 下载次数: 10)

捕获-时钟改.PNG

作者: 七彩雨    时间: 2023-10-19 14:19
端接电阻的位置要改吗?
作者: 七彩雨    时间: 2023-10-19 14:58
七彩雨 发表于 2023-10-19 14:19/ q, P4 I  h1 B8 F# Z
端接电阻的位置要改吗?
/ R! R$ q( F! A3 A
还是将端接电阻放于最后一片尾端,将阻值由1K改为36Ω,波形貌似正常了0 h  F0 e. i. ], h3 U: s# r

: Z( p* C) E# d

捕获u8-改阻值.PNG (1.02 MB, 下载次数: 4)

捕获u8-改阻值.PNG

作者: 七彩雨    时间: 2023-10-19 14:59
由此可见是端接电阻的阻值错了?
作者: aarom    时间: 2023-10-19 18:26
提示: 作者被禁止或删除 内容自动屏蔽




欢迎光临 EDA365电子论坛网 (https://eda365.com/) Powered by Discuz! X3.2